共有バスで接続されたマルチプロセッサのキャッシュメモリ構成
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概要
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モジュール性のよい共有バスで互いに接続されたマルチプロセッサ方式におけるキャッシュメモリの構成について考察した. 検討の中心は, プロセッサ個別にローカルキャッシュメモリを設けた場合, 各プロセッサの高性能化と, 共有バスの負荷低減とのトレードオフを, とくにオンラインリアルタイムで動作するというきびしい条件で定量評価したことである. その結果, (1)16バイトの比較的小さいブロックサイズのキャッシュメモリをプロセッサ側に実装することにより, 実効メモリリードサイクル数を20%に減少でき, かつバスの負荷を30%に減少できること, (2)オンラインでタスクスイッチが2msに1回の割合で発生する環境においても, 実効性能が1MIPSの計算機では, 90%以上のヒット率が得られること, を明らかにした.
- 一般社団法人情報処理学会の論文
- 1984-03-15
著者
-
福永 泰
(株)日立製作所日立研究所
-
福永 泰
株式会社日立製作所日立研究所
-
坂東 忠秋
株式会社日立製作所 日立研究所
-
坂東 忠秋
(株)日立製作所日立研究所
-
平沢 宏太郎
(株)日立製作所日立研究所
-
加藤 猛
(株)日立製作所中央研究所
-
加藤 猛
(株)日立製作所大みか工場計算制御設計部
-
福永 泰
(株)日立製作所研究開発本部
-
加藤 猛
(株)日立製作所 中央研究所
-
井手 寿之
(株)日立製作所大みか工場
-
坂東 忠秋
日立 日立研
-
平沢 宏太郎
(株)日立製作所大みか工場
-
平沢 広太郎
(株)日立製作所日立研究所第10部
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