RDRアーキテクチャを対象とした時間及び面積オーバーヘッドのないフォールトセキュア高位合成手法(システム設計技術,システム設計及び一般)
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概要
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本論文では,RDRアーキテクチャを対象とした時間及び面積オーバーヘッドのないフォールトセキュア高位合成手法を提案する.提案手法は,与えられた時間制約,面積制約のもとで演算処理を部分的に二重化し,ソフトエラーに起因するフォールトを検出することで信頼性の向上を図る.計算機実験の結果から,提案手法は従来手法と比較して,時間及び面積のオーバーヘッドなく信頼性を最大37.73%向上させることに成功した.
- 一般社団法人電子情報通信学会の論文
- 2013-05-09
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