ヘテロジニアスなマルチコアプロセッサ向け分散TLB機構の設計と実装(GPUとマルチコア,組込み技術とネットワークに関するワークショップETNET2012)
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概要
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組込みシステム向けマルチコアアーキテクチャでは,アプリケーションに合わせて大きさや機能,速度の異なるプロセッサやメモリ,及び各種I/OをNetwork-on-Chip(NoC)を用いて接続したヘテロジニアスな構成が有効である.本研究では,ヘテロジニアスなマルチコアプロセッサ向けに,分散TLB(Translation-Lookaside Buffer)を用いた効率的なメモリ管理機構を提案する.具体的には.コアごとに専用の小規模な1次TLB,及び全コアで共有する2次TLBを実装し,各コアにおいて1次TLBでミスが生じた場合のみ,2次TLBにアクセスする.このようなヘテロジニアスなマルチコアにおいて,コアごとの1次TLBサイズを調節することでTLB全体の高性能化及び面積コストの削減を図る.予備評価の結果,階層構造を持たないTLB機構の場合と比較して,分散TLB機構では面積と消費電力の軽減が確認された.
- 2012-02-24
著者
-
松谷 宏紀
東京大学大学院情報理工学系研究科
-
松谷 宏紀
慶應義塾大学理工学部
-
水頭 一壽
慶應義塾大学大学院理工学研究科開放環境科学専攻
-
山崎 信行
慶応大
-
山崎 信行
慶應義塾大学
-
水頭 一寿
慶應義塾大学大学院理工学研究科開放環境科学専攻
-
松谷 宏紀
慶應義塾大学環境情報学部:(現)慶應義塾大学大学院理工学研究科
-
松谷 宏紀
東京大学
-
川瀬 大樹
慶應義塾大学理工学部
-
水頭 一壽
慶應義塾大学
-
松谷 宏紀
慶應義塾大学
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