3次元NoCにおけるバスとネットワークを併用したルーティング手法(ネットワークオンチップ,デザインガイア2012-VLSI設計の新しい大地-)
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概要
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チップ間をワイヤレス接続した3次元積層チップは,製造後にチップの組み立て,入れ替えを自由にできる利点を持つ.そのため,チップ間の通信にワイヤレスバスを用いた3-D NoC(Network on Chip)では,アービタレスなタイムスロット・バスであるTDMA(Time Division Multiple Access)方式が適しているが,このバスが帯域,遅延の両面においてNoC通信性能のボトルネックとなる可能性が高い.そこで、本研究ではアービタレスの(垂直)バスの利用効率を向上させるルーティングElevatorを提案する.各チップがホモジニアスな構成である積層チップを想定したフルシステムシミュレーションを行った結果,典型的な最短経路ルーティングと比べて,本ルーティングアルゴリズムは最大13%のサイクル数削減に成功した.
- 一般社団法人電子情報通信学会の論文
- 2012-11-19
著者
-
鯉渕 道紘
国立情報学研究所
-
松谷 宏紀
東京大学大学院情報理工学系研究科
-
天野 英晴
慶應義塾大学
-
松谷 宏紀
慶應義塾大学環境情報学部:(現)慶應義塾大学大学院理工学研究科
-
鯉渕 道紘
国立情報学研究所|総合研究大学院大学
-
松谷 宏紀
東京大学
-
天野 英晴
慶應義塾大学 理工学部
-
松谷 宏紀
慶應義塾大学
-
加賀美 崇紘
慶應義塾大学 理工学部
-
加賀美 崇紘
慶應義塾大学
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