動的再構成可能プロセッサを用いたIPsec向け暗号処理アクセラレータの設計と実装(コンピュータシステム)
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概要
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近年の組込み機器の中核をなすSystem-On-a-Chip(SoC)では,マルチメディア処理やネットワークプロトコルなどの要求機能の多様化に伴い,専用ハードウェアの面積の増大,開発期間の増大が問題となっている.このような問題に対して,本研究では,処理回路を動的に再構成可能な動的再構成可能プロセッサをSoCに応用することにより解決を試みる.具体的には,NECエレクトロニクス社のDynamically Reconfigurable Processor(DRP)を用いて,IPsec向け暗号処理アクセラレータを実装し,その評価を行った.本アクセラレータは,組込みプロセッサとDRPの協調動作システムを想定すると同時に,異なる暗号処理回路を複数用意し,これらを必要に応じて切り換えながら動作する仮想ハードウェア機構を導入する.実装した暗号処理は,MIPS互換の組込みプロセッサと比較して最大で7.8倍のスループットを達成した.また,仮想ハードウェアによるオーバヘッドの解析を行い,ダブルバッファ方式を採用することで,約80.7%のオーバヘッドを削減可能であることを示した.
- 社団法人電子情報通信学会の論文
- 2006-04-01
著者
-
長谷川 揚平
慶應義塾大学
-
松谷 宏紀
東京大学大学院情報理工学系研究科
-
松谷 宏紀
慶應義塾大学理工学部
-
安生 健一朗
NECエレクトロニクス通信システム事業部
-
安生 健一朗
Necエレクトロニクス株式会社
-
粟島 亨
日本電気株式会社
-
粟島 亨
Necシステムデバイス研究所
-
阿部 昌平
慶應義塾大学大学院理工学研究科
-
天野 英春
慶應義塾大学大学院理工学研究科
-
松谷 宏紀
慶應義塾大学:(現)東京大学大学院情報理工学系研究科
-
松谷 宏紀
慶應義塾大学
-
安生 健一朗
NECエレクトロニクス 通信システム事業部
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