動的なスイッチング情報を用いたパワーゲーティング回路向け高精度遅延時間解析法の提案(論理設計2,デザインガイア2010-VLSI設計の新しい大地-)
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概要
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パワーゲーティング回路向けのゲート遅延解析法を提案する.提案手法では動的タイミング解析に基づく論理ゲートのスイチンッグ情報の取得,および仮想グランド線電位解析の高精度化によって従来手法と比較して悲観性を大きく削減した遅延解析ができる.評価の結果,スリープトランジスタの面積率が27%の3bit Ripple Carry Adderにおいて,従来手法と比較して57パーセンテージポイントの誤差の改善を達成した.
- 2010-11-22
著者
-
宇佐美 公良
芝浦工業大学
-
武田 清大
芝浦工業大学
-
中村 宏
東京大学
-
宇佐美 公良
芝浦工業大学工学部
-
武田 清大
東京大学
-
武田 清大
東京大学大学院
-
武田 清大
東京大学工学系研究科先端学際工学専攻
-
金 均東
東京大学工学系研究科先端学際工学専攻
-
中村 宏
東京大学情報理工学系研究科システム情報学専攻
-
中村 宏
東京大学工学部
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