動的リコンフィギャラブルプロセッサにおける、2電源電圧の動的な割り当てによる電力削減機構の実装(低消費電力設計,FPGA応用及び一般)
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概要
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動的リコンフィギャラブルプロセッサのPEに対して2電源電圧手法を適用し、動作時のダイナミック電力の低減を実現する。我々は過去にゲートレベルのシミュレーションにおいて2電源電圧手法は有効であると示すことができた。本稿では、電源線を切り替える際の電力や面積の増加など、より詳細について検証するために、2電源電圧手法を実現するために必要な回路を含めて実デザインを設計した。その設計を、回路シミュレーションでアプリケーションを動作させてエネルギーの低減率を調べたところ、1.2Vと0.9Vの組み合わせにおいて最大44%にまで低減できることがわかった。
- 社団法人電子情報通信学会の論文
- 2010-01-19
著者
-
宇佐美 公良
芝浦工業大学
-
天野 英晴
慶応義塾大学
-
宇佐美 公良
芝浦工業大学工学部
-
天野 英晴
慶應義塾大学理工学部
-
小山 慧
芝浦工業大学
-
馬橋 雄祐
芝浦工業大学
-
齊藤 貴樹
慶応義塾大学理工学部
-
佐野 徹
慶応義塾大学大学院理工学研究科開放環境科学専攻
-
天野 英晴
慶應義塾大学 理工学部
-
佐野 徹
慶應義塾大学
-
齊藤 貴樹
慶應義塾大学
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