ランタイムパワーゲーティングを適用した低電力乗算器の設計試作及び実測による性能評価(低消費電力回路,システムオンシリコンを支える設計技術)
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概要
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ランタイムパワーゲーティング(RTPG)を適用した低電力乗算器を,90nmプロセスを用いて設計試作した.シミュレーション評価ではリーク電力とグラウンド・バウンスの低減効果を検証し,実測評価ではリーク電力と動作速度について解析した.実測において,RTPG適用によるリーク電力低減効果は,高温時で22%であった.
- 2009-03-04
著者
-
白井 利明
大阪教育大学
-
白井 利明
芝浦工業大学
-
宇佐美 公良
芝浦工業大学
-
武田 清大
芝浦工業大学
-
中田 光貴
芝浦工業大学
-
宇佐美 公良
芝浦工業大学工学部
-
武田 清大
東京大学
-
武田 清大
東京大学大学院
-
武田 清大
東京大学工学系研究科先端学際工学専攻
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