GaAs DCFL回路の信号遅延・消費電力に対する配線容量の影響
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概要
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GaAs論理回路の性能(信号遅延T_dと消費電力P)に対する配線容量C_lの影響を検討した。解析した回路は0.5μm GaAs MESFET DCFL技術を用いて設計した15段リングオシレータ(R.O.)と16ビットNOR型BLC加算器である。C_l,W(MESFETのチャネル幅)を変数として、T_dとPの変化をSPICEで解析した。この結果、C_lが一定の時、T_dはWに反比例し、PはWに比例することがわかった。
- 1995-09-05
著者
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