超高速GaAs加算回路の待機時消費電力除去技術
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概要
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GaAsディジタル回路の待機時消費電力Pstは貫通電流Ithに支配され、その値は極めて大きいため、回路をFETスイッチSWで切り離し、これを除去することが望ましい。本報告では、まずSW駆動回路の構成、性能を詳述する。次にSWを加算回路に適用し、SWの効果と影響を検討する。
- 1996-09-18
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