制御処理ハードウェア高位合成のためのコントロールデータフローグラフ変形手法
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概要
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制御処理ハードウェアの高位合成システムにおける,ハードウェアの実行時間の削減を実現するコントロールデータフローグラフ変形手法を提案する.本高位合成システムは,アプリケーションプログラム記述から,状態数が最小で且つ高速な演算器が割り当てられ高速に動作する初期状態、遷移グラフを初期ハードウェア候補として出力する.提案するコントロールデータフローグラフ変形手法は2つのアプローチにより,(1)初期状態遷移グラフの実行クロックサイクル数の削減,(2)初期状態遷移グラフのクロック周期の削減,を実現する.(1)を部分コントロールデータフローグラフの複製処理によるパス長の削減により実現する.(2)を一算術演算処理内のメモリ読み込み処理と演算処理を異なるイタレーションに分散させるパイプライン実行により実現する.計算機実験により提案手法の有効性を示す.
- 2002-03-01
著者
-
柳澤 政生
早稲田大学基幹理工学研究科情報理工学専攻
-
大附 辰夫
早稲田大学基幹理工学研究科情報理工学専攻
-
大附 辰夫
早稲田大学
-
戸川 望
北九州市立大学国際環境工学部情報メディア工学科
-
石井 哲雄
早稲田大学理工学部電子・情報通信学科
-
柳澤 政生
早稲田大学
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