連想プロセッサを用いた多層化改良線分展開法
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概要
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VLSIのレイアウト設計において,迷路法のような格子構造を用いない配線手法(グリッドレスルータ)の一つに改良線分展開法がある.我々は,連想メモリを用いたハードウェアエンジンで改良線分展開法を高速化する手法について報告を行ってきた.近年,改良線分展開法を3層以上の多層配線ができるように拡張した手法(以後,多層化線分展開法と呼ぶ)が提案されている.この手法は多層の配線問題を扱うため単層の場合と比べて処理を複雑であり,大きな処理時間を要している.本稿ではこの多層化線分展開法を,連想メモリを用いたハードウェアエンジンで高速化する手法およびその評価について述べる.ここで用いるハードウェアエンジンは,新たに開発したCAMチップを用いて製作したものであり,で用いたものと比べてより高速で効率の良い図形処理が可能となっている.以下では,多層化線分展開法のアルゴリズムを示し,連想メモリとそれを用いたハードウェアエンジン,および連想メモリによる図形探索処理について述べる.さらに多層化線分展開法をハードウェアエンジン上に実装し,ソフトウェアとの処理速度の比較実験を行い,その評価を行う.
- 一般社団法人情報処理学会の論文
- 1992-09-28
著者
-
大附 辰夫
早稲田大学基幹理工学研究科情報理工学専攻
-
佐藤 政生
早稲田大学理工学部
-
大附 辰夫
早稲田大学理工学部
-
大附 辰夫
早稲田大学
-
中村 恵介
早稲田大学理工学部
-
桑原 泰雄
早稲田大学理工学部
-
久保田 和人
早稲田大学理工学部
-
久保田 和人
早稲田大学理工学部電子通信学科
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