低消費電力プロセッサアーキテクチャ向けクリティカルパス予測器の提案
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概要
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近年の研究でスーパスカラプロセッサ上でプログラム中のクリティカルパスを効率良く実行することにより,プロセッサの処理性能を向上させることが可能であうことが知られている.我々の研究では実行中の命令がクリティカルであるかどうかの情報を用いて.プロセッサの処理性能を低下させることなく消費電力を削減させることを目指す.本稿では,我々が提案する新たなクリティカルパス予測器を用いて低消費電力化の最適化評価を行った結果について報告する.
- 一般社団法人情報処理学会の論文
- 2002-08-22
著者
-
千代延 昭宏
九州工業大学大学院 情報工学研究科
-
佐藤 寿倫
九州工業大学知能情報工学科
-
有田 五次郎
九州産業大学知能情報工学科
-
有田 五次郎
九州工業大学情報工学部知能情報工学科
-
有田 五次郎
九州工業大学
-
有田 五次郎
九州産業大学情報科学部
-
千代延 昭宏
九州工業大学情報工学部知能情報工学科
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