タイミング違反を利用した省電力プロセッサにおける履歴を用いた性能低下抑制手法(省電力, 「ハイパフォーマンスコンピューティングとアーキテクチャの評価」に関する北海道ワークショップ(HOKKE-2006))
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概要
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近年,半導体の微細化技術の向上によりタイミング制約が重要視されている中で,高性能かつ低電力のプロセッサが求められている.我々は,タイミング違反を利用した低電力方式の提案をしてきた.本稿では,この建設的タイミング違反方式を適用することで被る,性能へのペナルティを削減する方式を検討している.
- 一般社団法人情報処理学会の論文
- 2006-02-27
著者
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