マイクロプロセッサ向けフォールトトレランス技術におけるペナルティ削減
スポンサーリンク
概要
- 論文の詳細を見る
本稿は、過渡故障に耐性を持つ信頼性の高いマイクロプロセッサを検討する。マイクロプロセッサ向けのフォールトトレランス技術が必要となる理由には以下の二つが考えられる。ひとつは半導体のディープサブミクロン技術である。近い将来の半導体プロセスは、α粒子などの影響を受けやすいと考えられている。もうひとつは携帯機器の普及である。携帯電話上での、セキュリティに関わるアプリケーション実行では、計算機は常に正しく動作するものとして期待されている。これらの背景を鑑みて、われわれは時間的な冗長性を利用したマイクロプロセッサ向けのフォールトトレランス機構を既に提案している。残念ながら、本機構導入によるプロセッサ性能の低下は著しい。そこで本稿ではペナルティの削減を検討する。詳細な評価の結果、分岐予測機構の投機的更新と、冗長なデータキャッシュアクセスの抑制が、非常に有効であることを確認した。
- 2001-07-18
著者
関連論文
- FPGAによるDSP向け多機能メモリの実現
- FPGA/CPU混載システムのためのC言語による協調設計環境の実現(コデザイン)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会)
- FPGA/CPU混載システムのためのC言語による協調設計環境の実現(コデザイン)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- FPGA/DSPベースシステムによる組込みシステム設計教育(コンピュータシステム)
- FPGA/CPU混載システムのためのC言語による協調設計環境の実現 (デザインガイア 2004--VLSI設計の新しい大地を考える研究会)
- FPGAによるDSP向け多機能メモリの実現(システムLSIの応用とその要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- C-4 HW/SW協調動作に対するブロックダイアグラム環境利用に関する一評価(FPGA,C.アーキテクチャ・ハードウェア)
- FPGA/DSPによる協調処理環境の構築
- SHOKE2000:PCI-Based FPGA Cardの開発とその評価
- FPGAを実装したPCIカードによる分散共有メモリ型並列計算機の構築
- 情報駆動学の実現抽象化階層とドメイン・モデリングから見たミドルウェアに関する一考察
- 各種プラットフォームにおけるDSMクラスタの性能と拡張性に関する評価
- 各種プラットフォームにおけるDSMクラスタの性能と拡張性に関する評価
- TCP/IPプロトコル処理の高速化に関する評価
- タスク並列処理を用いたソフトウエア分散共有メモリの提案(プロセッサシステムとプログラミング環境)
- 並列処理システムにおける同期のためのオーバーヘッドの削減とスケジューリングについて
- 2000-ARC-139-30 キュー構造プログラムカウンタによる多重投機実行機構
- 情報駆動学の実現抽象化階層とドメイン・モデリングから見たミドルウェアに関する一考察
- FPGAを実装したPCIカードによる分散共有メモリ型並列計算機の構築
- FPGAを実装したPCIカードによる分散共有メモリ型並列計算機の構築
- 2H-4 PCIカードを用いた共有メモリ制御モジュールの設計
- FPGAによるDSP向け多機能メモリの実現(システムLSIの応用とその要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- FPGAによるDSP向け多機能メモリの実現(システムLSIの応用とその要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- FPGAによるDSP向け多機能メモリの実現(システムLSIの応用とその要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- FPGAによるDSP向け多機能メモリの実現
- 位置情報を考慮した車椅子利用者向けモバイル端末用ナビゲーションシステムのフレームワーク(セッション2-B : 位置情報サービス)
- 位置情報を考慮した車椅子利用者向けモバイル端末用ナビゲーションシステムのフレームワーク(セッション2-B : 位置情報サービス)
- TCPを用いた分散環境のための電子黒板システムとその性能評価
- TCPを利用した分散ネットワーク環境のための電子黒板システム
- 工学系学生のための情報処理集合教育環境の設計と構築
- 正規トレース集合を用いた並行分散プロセスの合成
- HYPHENクラスタにおける基本プリミティブの設計と実装
- FPGA/CPU混載システムのためのC言語による協調設計環境の実現(コデザイン)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- FPGA/CPU混載システムのためのC言語による協調設計環境の実現(コデザイン)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- 低消費電力プロセッサアーキテクチャ向けクリティカルパス予測器の評価(システムLSIのための先進アーキテクチャ論文)
- 建設的タイミング違反方式に基づくALUのHDL設計とその評価(システムオンシリコン設計技術並びにこれを活用したVLSI)
- 建設的タイミング違反方式に基づくALUのHDL設計とその評価(システムオンシリコン設計技術並びにこれを活用したVLSI)
- 可変レイテンシパイプライン技術と演算結果再利用技術の併用による演算レイテンシ削減
- 値予測を用いた命令流分割によるエネルギー消費量削減
- 命令冗長性を利用したフォールトトレラントプロセッサ
- 命令冗長性を利用したフォールトトレラントプロセッサ
- 命令冗長性を利用したフォールトトレラントプロセッサ
- 低消費電力プロセッサアーキテクチャ向けクリティカルパス予測器の提案
- 大規模スーパースカラプロセッサ向け命令発行機構
- 大規模スーパースカラプロセッサ向け命令発行機構
- 大規模スーパースカラプロセッサ向け命令発行機構
- 並列プログラミングライブラリPPElibにおける適応型メモリバッファリングの実装と評価(並列処理)
- クラス継承による並列プログラミングライブラリの設計と実装
- Javaベース広域並列処理環境の構築
- 同期操作を隠蔽した並列プログラミングライブラリの実装と評価
- ハードウェア記述言語を用いたマルチキャッシュシステムのモデル化と性能評価
- 分散処理システムを利用した並列処理環境における通信処理の影響
- 書換え可能なLSIによる可変構造型相互結合網の実現法 (並列処理)
- MIMD型並列計算機HYPHEN C-16における性能評価用プログラミングシステム
- MIMD型並列計算機における2進木構造アクセス機構の性能評価
- 階層構造高多重並列計算機実験システムHYPHEN C-16について
- 階層ル-チングバスについて
- プログラマブル論理ICを用いたH-Rバス用スイッチの設計
- FIFOキューを同期手段とする並列プログラムについて(III) : 実行管理機構
- 並列処理マシンHYPHENB-16の実行管理機構
- UNIXネットワークにおける並列実行環境の構築
- FPGA/DSPによる協調処理環境の構築
- FPGA/DSPによる協調処理環境の構築
- コンパイラ最適化レベルのデータ投機実行に与える影響
- クリティカルパス情報を利用するキャッシュメモリにおけるデータの重要度に関する調査(プロセッサアーキテクチャ及び関連技術, デザインガイア2005-VLSI設計の新しい大地を考える研究会--コンピュータシステムの設計・検証技術及び一般-)
- 命令の振る舞いを利用した消費電力削減に関する検討(ARC-10 : 低電力化)(2004年並列/分散/協調処理に関する『青森』サマー・ワークショップ(SWoPP青森2004) : 研究会・連続同時開催)
- 建設的タイミング違反方式を適用したALUの改良とその評価(ARC-2 : プロセッサアーキテクチャII)(2004年並列/分散/協調処理に関する『青森』サマー・ワークショップ(SWoPP青森2004) : 研究会・連続同時開催)
- プログラムの実行時における命令の重要度決定に関する検討(ARC-1:プロセッサ)(2003年並列/分散/協調処理に関する『松江』サマー・ワークショップ(SWoPP松江2003))
- 0/1の局所性を利用したデータ値予測機構のハードウエア量削減
- COSMOSプロセッサにおける最適化の一実施例
- COSMOSプロセッサにおける最適化の一実施例
- COSMOSプロセッサにおける最適化の一実施例
- マイクロプロセッサ向け低消費電力アーキテクチャのHDL設計とその評価
- マイクロプロセッサ向けフォールトトレランス技術におけるペナルティ削減
- 遅延故障を考慮したフォールトトレランス技術に基づく低消費電力方式
- 遅延故障を考慮したフォールトトレランス技術に基づく低消費電力方式
- 頻繁な値の局所性を考慮したデータ値予測機構のハードウェア量削減
- COSMOSプロセッサにおける最適化の有効性
- 頻繁な値の局所性を考慮したデータ値予測機構のハードウエア量削減
- COSMOSプロセッサにおける最適化の有効性
- タグビット幅を考慮したデータ値予測機構のハードウエア量削減
- KIT COSMOSプロセッサ : 背景と着想
- KIT COSMOSプロセッサ : 背景と着想
- KIT COSMOSプロセッサ : 背景と着想
- 命令レベル並列プロセッサにおける可変レイテンシパイプラインの効果
- 5H-5 DSPとCPUによるジェスチャ認識プログラムの作成
- 並列処理システムにおける同期のためのオ-バヘッドの削減について
- FIFOキューを同期手段とする並列プログラムの実行における同期のためのオーバーヘッドの削減について(計算アルゴリズムの基礎理論)
- 2H-5 FPGA/DIMMを実装したPCIカードの作製
- 情報駆動学の実現抽象化階層とドメイン・モデリングから見たミドルウェアに関する一考察
- 命令カスケーディングにおける典型的パス遅延の効用(自律・並列分散システムにおける動的最適化, 自律協調システム及び一般)
- 低消費電力指向マルチスレッドプロセッサのための低コスト値予測機構の検討(プロセッサアーキテクチャ)
- 低消費電力指向マルチスレッドプロセッサのための低コスト値予測機構の検討