タグビット幅を考慮したデータ値予測機構のハードウエア量削減
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概要
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近年値予測を用いたデータ依存の投機的実行が注目されているが、値予測のためのハードウエア量が問題となっている.本稿では, 値予測機構のハードウエア量を削減することを検討している.具体的にはタグアレイ部に保持されるアドレスのビット幅削減を検討している.キャッシュとは異なり, 値予測では得られた値が必ずしも正しくなくて構わない.なぜなら値予測に失敗した場合のための機構が備わっているからである.したがって, タグアレイ部に保持されるアドレスのビット幅を削減しても, プログラムの実行結果には問題無い.シミュレーションの結果, タグアレイ部は2ビットあれば十分で, プロセッサの性能に悪影響を及ぼさないことが確認された.これは, 標準的な4096エントリの値予測機構の場合で8Kバイトのハードウエア量削減に相当する.
- 2000-04-21
著者
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