ディジタル信号処理向けプロセッサのためのシミュレータ生成手法(<特集>システムLSIの設計技術と設計自動化)
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概要
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本稿では,DSPを対象としたハードウェア/ソフトウェア協調合成システムにおいて,対象プロセッサの構成を評価し,アセンブリコードの検証を行うシミュレータの生成手法を提案する.本システムは異なるアプリケーションを対象とすると,異なるプロセッサ構成を出力するため,シミュレータはプロセッサ構成に対応するようにリターゲッタブルに生成されなければならない.提案手法はプロセッサの機能ユニット,パイプライン構成,命令セット,フォワーディングユニットの記述から,プロセッサに含まれる機能ユニットの種類と個数,パイプライン段数や各ステージおける動作,命令のパイプライン内の動作,フォワーディングユニットの動作を解析し,これらをC++記述で表し,この記述をもとにパイプラインシミュレータおよび命令セットシミュレータを生成する.いくつかのプロセッサ構成について生成したシミュレータの計算機実験結果を示し,提案手法の有用性を示す.
- 一般社団法人情報処理学会の論文
- 2002-05-15
著者
-
柳澤 政生
早稲田大学基幹理工学研究科情報理工学専攻
-
大附 辰夫
早稲田大学基幹理工学研究科情報理工学専攻
-
大附 辰夫
早稲田大学
-
戸川 望
北九州市立大学国際環境工学部情報メディア工学科
-
笠原 亨介
早稲田大学理工学部電子・情報通信学科
-
柳澤 政生
早稲田大学
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