動的遅延分布の高速な見積もり手法(システムLSIの応用と要素技術,プロセッサ,DSP,画像処理技術及び一般)
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概要
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ディジタル回路の高性能化は,現在主流の固定レイテンシ方式では限界に近づいており,可変レイテンシ方式の採用による回路のさらなる高性能化が期待されている.高性能な可変レイテンシ回路の実現のためには,その動作や性能を見積もるため,素子遅延の製造バラつきなどによる静的な遅延分布だけでなく,入力パターンの違いを考慮した回路の動的な遅延分布を知ることも必要である.回路の動的遅延分布は必要な入力パターンの系列をすべてシミュレーションすることにより正確に求めることはできる.しかし,計算量は回路の入力数の指数オーダーとなるため,小規模な回路を除き現実的な方法ではない.本研究では,信号遷移事象の生起確率を用いて,より少ない計算量で動的遅延分布を見積もる手法を提案する.計算機実験による結果から,提案手法によってより高速に得られた見積もりが,入力パターンのシミュレーションに近いことを確認した.
- 2012-10-11
著者
-
高橋 篤司
大阪大学大学院工学研究科電気電子情報工学専攻
-
高橋 篤司
東京工業大学大学院理工学研究科集積システム専攻
-
高橋 篤司
東京工業大学 工学部 電気・電子工学科
-
Takahashi Atsushi
Division of Electrical, Electronic and Information Engineering, Osaka University
-
高橋 篤司
東京工業大学
-
TAKAHASHI Atsushi
Graduate School of Science and Technology, Tokyo Institute of Technology
-
高橋 篤司
大阪大学 大学院 工学研究科 電気電子情報工学科専攻
-
Takahashi Atsushi
Division Of Electrical Electronic And Information Engineering Osaka University
-
高橋 篤司
大阪大学大学院工学研究科電気電子情報工学科専攻:大阪大学工学部電子情報工学科
-
安藤 健太
大阪大学大学院工学研究科電気電子情報工学科専攻
-
Takahashi Atsushi
The Department Of Communications And Integrated Systems Tokyo Institute Of Technology
-
秋田 大
大阪大学大学院生命機能研究科
-
Takahashi Atsushi
Department of Communications and Computer Engineering, Tokyo Institute of Technology
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