スケジュール可能範囲を考慮したクロック木合成手法
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概要
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各レジスタへ同時刻にクロックを分配することを前提としない準同式期回路において, レジスタ集合がいくつかの半径の小さいクラスタに分割され, クロックスケジュールがクラスタ内のレジスタのクロックタイミングが等しいという条件で与えられたとき, そのクロックスケジュールを実現するクロック木の構成法を提案する.提案手法は配線長の最小化を目的とするクラスタ内配線と, 配線長および使用するバッファ数の削減を目的とするクラスタ間配線により, レジスタ間のクロックタイミングの差を満たし, バッファからそのバッファが駆動するレジスタやバッファまでのパス長を配線遅延を無視できる範囲に抑えた, 低消費電力化を実現するクロック木を構成する.実験により, 提案手法により得られる準同期式設計におけるクロック木は完全同期式設計に比べ, 12%の低消費電力化が達成できることが確かめられ, 本手法の有効性が確認された.
- 一般社団法人情報処理学会の論文
- 2000-09-07
著者
-
高橋 篤司
東京工業大学大学院理工学研究科集積システム専攻
-
高橋 篤司
東京工業大学集積システム専攻
-
高橋 篤司
東京工業大学
-
東 昌秋
東京工業大学集積システム専攻
-
斉藤 誠
東京工業大学理工学研究科集積システム専攻
-
斉藤 誠
東京工業大学集積システム専攻
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