製造後にタイミング補正可能なオンチップバスアーキテクチャ(回路方式,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)
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概要
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トランジスタの微細化が進むにつれて,配線に起因する遅延時間の影響が増大している.特にバス配線では複数の配線が長距離並走するため,配線間容量が大きく結果的に遅延時間が増大してしまう.また微細化が進むにつれて,製造時に生じるばらつきに起因する回路性能のばらつきが顕著になってきている.回路性能のばらつきによって,仕様どおりに動作しない回路が増加する.本稿では,バス遅延の増大や性能ばらつき等に対処すべく,製造後にタイミング補正可能なオンチップバスアーキテクチャについて述べる.
- 社団法人情報処理学会の論文
- 2007-11-20
著者
-
石原 亨
九州大学システムLSI研究センター
-
安浦 寛人
九州大学大学院システム情報科学研究院
-
安浦 寛人
九州大学大学院システム情報科学研究科情報工学専攻
-
山口 聖貴
九州大学大学院システム情報科学府
-
室山 真徳
九州大学システムLSI研究センター
-
Yasuura Hiroto
The Graduate School Of Engineering Sciences Kyushu University
-
Yasuura Hiroto
Department Of Computer Science And Communication Engineering Graduate School Of Information Science
-
Yasuura Hiroto
Kyushu Univ. Fukuoka‐shi Jpn
-
山口 聖貴
九州大学大学院 システム情報科学府
-
安浦 寛人
九州大学大学院 システム情報科学研究院
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