シングルサイクルアクセス可能な二階層キャッシュアーキテクチャ(消費電力,組込技術とネットワークに関するワークショップETNET2009)
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概要
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組込みプロセッサのメモリサブシステムの消費エネルギーを削減するために,プロセッサコアとL1キャッシュメモリ(以下,キャッシュメモリを単にキャッシュという)の間に小容量のL0キャッシュを配置する技術が広く利用されている.L0キャッシュは小容量であるためキャッシュヒットすれば消費エネルギーを削減できる.しかし,キャッシュミスした場合,L1キャッシュへアクセスするために最低1サイクル必要となり,プロセッサの性能低下を引き起こす.この問題を解決するため,シングルサイクルアクセス可能な二階層キャッシュ(STC:Single-cycle-accessible Two-level Cache)アーキテクチャを本稿で提案する.STCアーキテクチャでは,プロセッサコアはシングルサイクルで小容量キャッシュまたはL1キャッシュにアクセスできる.さらに,STCアーキテクチャを有効活用するコンパイル技術も本稿で提案する.ベンチマークを用いた実験では,L0キャッシュを用いたアプローチと比較して,メモリサブシステムの消費エネルギーを最大で64%,平均で41%削減できた.
- 社団法人電子情報通信学会の論文
- 2009-02-26
著者
-
石原 亨
九州大学システムLSI研究センター
-
安浦 寛人
九州大学大学院システム情報科学研究院
-
安浦 寛人
九州大学
-
安浦 寛人
九州大学大学院システム情報科学研究科情報工学専攻
-
山口 誠一朗
九州大学大学院システム情報科学府
-
安浦 寛人
九州大学 大学院 システム情報科学研究科
-
Yasuura Hiroto
The Graduate School Of Engineering Sciences Kyushu University
-
Yasuura Hiroto
The Department Of Computer Science And Communication Engineering Graduate School Of Information Scie
-
Yasuura Hiroto
Department Of Computer Science And Communication Engineering Graduate School Of Information Science
-
Yasuura Hiroto
Kyushu Univ. Fukuoka‐shi Jpn
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