ED2000-116 / SDM2000-98 / ICD2000-52 3しきい値CMOS/SIMOX回路構成法による低電力54x54-b乗算器
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概要
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3しきい値CMOS/SIMOX回路構成法により, 54x54ビット乗算器を作製した.高速化のため, クリティカルパスの負荷容量を削減するマルチプレクサ回路を開発し, 乗算器内部の多ビット加算器に適用した.低消費電力のため, 乗算器のCMOS論理部を, 低および中の2種類のしきい値電圧のMOSFETから構成し, その割り振りをEDAツールを用いて自動的に行った.試作した乗算器は, 0.5V電源で遅延時間31ns, 消費電力2.8mWであった.
- 社団法人電子情報通信学会の論文
- 2000-08-17
著者
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