一括並列処理によるHMM高速化手法及びそのVLSI設計
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概要
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本論文では,高速な音声認識LSIの実現を目的とした,連続分布型HMMの並列処理による高速化及びVLSI設計を行った.連続分布型HMMは認識性能が高い反面,出力確率計算にかかる計算量が多く,高速化が重要となっている.出力確率計算の高速化方法としてブロック単位の並列処理及びその処理を実行するアーキテクチャを提案する.また,固定小数点演算による認識処理を実行する最小かつ最適なビット幅を考察した.提案したアーキテクチャに基づきHMMのVLSI設計及び評価を行い,100単語分の認識処理時間は約3msと実時間応答の認識システムを構築するのに十分な性能があることがわかった.
- 社団法人電子情報通信学会の論文
- 2002-12-01
著者
-
宮永 喜一
北海道大学工学部
-
吉田 則信
北海道大学大学院工学研究科
-
宮永 喜一
北海道大学
-
吉沢 真吾
北海道大学大学院工学研究科
-
吉田 則信
北海道大学大学院 工学研究科情報通信エレクトロニクス講座
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