4x4 MIMO-OFDM受信機における動的再構成可能なMMSE検出器のLSI設計(スマートパーソナルシステム,一般)
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概要
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本報告では4x4 MIMO-OFDM受信機における動的再構成可能なMMSE検出器のVLSIアーキテクチャを提案する.MIMO-OFDM方式ではMIMO復号においてサブキャリア毎の逆行列計算を実時間処理で行う専用回路が実現されているが,システムの小型化・低消費電力化が必至であるため,回路規模の縮小化が要求される.提案手法では,ストラッセン方式行列乗算および逆行列計算において動的再構成アーキテクチャを導入し,MIMO-OFDM受信機MMSE検出器での許容遅延内で演算回路を最適化する.これにより提案法は従来法よりも大幅な回路規模および消費電力の削減を達成している.MMSE検出回路をCMOS 90nmプロセス上に実装したときの処理遅延,回路面積,消費電力について従来法と比較評価した.
- 2009-06-04
著者
-
吉澤 真吾
北海道大学大学院情報科学研究科
-
宮永 喜一
北海道大学工学部
-
池内 博一
北海道大学大学院情報科学研究科
-
宮永 喜一
北海道大学
-
宮永 喜一
北海道大学大学院 工学研究科情報通信エレクトロニクス講座
-
宮永 喜一
三菱電機特機システム株式会社
-
吉澤 真吾
北海道大学大学院 工学研究科情報通信エレクトロニクス講座
-
吉澤 真吾
北海道大学 大学院情報科学研究科
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