Spec-Design CADを用いたハードウェアシステムのIP利用に関する考察
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概要
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本研究ではユーザーが所望の機能と仕様を備えた回路のRTL段階における設計データであるVerilog-HDLソースを自由に生成できるシステムとして、Spec-Design CADを試作した。ユーザーインターフェースとしてGUIを採用し、生成される回路のスペックに関する情報をあらかじめ予測し、ユーザー側に即座にフィードバックさせることによってユーザーによる設計パラメータの設定を容易なものにした。本稿ではSpec-Design CADのテストケースとしてDFT演算回路の自動生成に取り組み、その自動生成までのパラメータの設定、設計データの生成などの仕組みについて説明する。
- 2002-11-21
著者
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