4×4 MIMO-OFDM受信機におけるパイプライン型MMSE検出器のVLSIアーキテクチャ設計(スマートパーソナルシステム,一般)
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概要
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本報告では4×4 MIMO-OFDM受信機におけるMMSE検出器のVLSIアーキテクチャを提案する.パケット通信をベースとしたMIMO-OFDM方式ではMIMO復号においてサブキャリア毎の逆行列計算を実時間処理で行う必要があるため,相当量のスループット性能が要求される.そのためMIMO復号処理の回路はパイプライン処理で行われることが望ましい.本研究ではストラッセン方式の行列乗算及び逆行列計算を用いたパイプラン処理型MMSE検出器回路を提案する.提案回路はOFDMサブキャリア数に依存せず実時間処理でのMMSE検出処理を可能とする.また,MMSE検出回路をCMOS 90nmプロセス上に実装し,処理遅延,回路面積,消費電力を評価したのでその結果も合わせて報告する.
- 2008-06-05
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