8x8 MIMO-OFDM受信機におけるパイプライン型MDCアーキテクチャを用いた128点FFTプロセッサの回路設計(システムオンシリコン,RFID技術,一般)
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概要
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本報告では8x8 MIMO-OFDM受信機における128点FFTプロセッサのVLSIアーキテクチャを提案する.4x4 MIMO-OFDM受信機におけるFFTプロセッサでは,パイプライン型MDC(multi-path delay commutator)アーキテクチャを用いることで効率的な回路が実現されているが,今後は高速・大容量の通信を実現するため,ストリーム数を増加させたMIMO-OFDM受信機に対応したFFTプロセッサの開発が必要であると考えられる.本研究では8x8 MIMO-OFDM受信機においてMDCアーキテクチャを適用させた回路を提案する.提案回路はメモリバッファの前後に整流回路(commutator)を設けることで遅延器を削減している.また,FFTプロセッサをCMOS 90nmプロセス上に実装したときの回路面積,消費電力を評価したのでその結果も合わせて報告する.
- 社団法人電子情報通信学会の論文
- 2010-11-25
著者
-
吉澤 真吾
北海道大学大学院情報科学研究科
-
宮永 喜一
北海道大学大学院情報科学研究科
-
宮永 喜一
北海道大学情報科学研究科
-
宮永 喜一
北海道大学大学院工学研究科
-
宮永 喜一
Division Of Electronics And Information Engineering Graduate School Of Engineering Hokkaido Universi
-
折笠 敦史
北海道大学大学院情報科学研究科
-
宮永 喜一
北海道大学工学部電子工学科
-
宮永 喜一
北海道大学
-
宮永 喜一
北海道大学大学院
-
宮永 喜一
北海道大学大学院 工学研究科情報通信エレクトロニクス講座
-
Miyanaga Yoshikazu
Division Of Electronics And Information Engineering Graduate School Of Engineering Hokkaido Universi
-
宮永 喜一
三菱電機特機システム株式会社
-
吉澤 真吾
北海道大学大学院 工学研究科情報通信エレクトロニクス講座
-
吉澤 真吾
北海道大学 大学院情報科学研究科
-
宮永 喜一
北海道大学大学院情報科学研究科情報通信ネットワーク研究室
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