パワーダウン・アプリケーションに適した1V高速MTCMOS回路技術
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概要
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近年、携帯機器の需要の増加にともない、低電圧動作・パワーマネージメントなどの低電力化技術の要求が高まっている。本報告はこのようなパワーダウン・アプリケーションに適した新しいMTCMOS回路構成に関するものである。この回路構成により、電源が供給されないパワーダウン時においても回路中のデータを保持することが可能となる。また通常動作時は、論理回路のクリティカルパスから記憶回路を切り離すことで低電力・高速動作を実現する。本回路構成を適用した8Kゲート規模LSIを0.5-μm CMOSプロセスにより試作し、1V-20MHz動作、数nAのスタンバイ電流を実現した。
- 社団法人電子情報通信学会の論文
- 1995-07-28
著者
-
武藤 伸一郎
NTTマイクロシステムインテグレーション研究所
-
武藤 伸一郎
日本電信電話株式会社NTTマイクロシステムインテグレーション研究所
-
松谷 康之
NTT LSI研究所
-
山田 順三
NTT LSI研究所
-
松谷 康之
Nttマイクロシステムインテグレーション研究所
-
山田 順三
Ntt 通信エネルギー研
-
山田 順三
Ntt
-
松谷 康之
NTTシステムエレクトロニクス研究所
-
武藤 伸一郎
NTT LSI研究所
-
重松 智志
NTT LSI研究所
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