Hierarchical Circuit Optimization for Analog LSIs using Device Model Refining
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概要
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本論文では、素子モデル更新法を用いた新しい素子値最適設計手法を提案する。本手法では、処理時間短縮と高精度最適化の同時実現を目指すため、まず、最適化の初期段階において単純な素子モデルを用いて高速に最適化を行ない、徐々に素子モデルを精密なモデルに更新していく。次に、最終的にシミュレータで用いられている精密モデルを用い、高精度の最適解を探索する。実際に演算増幅回路について設計実験を行なったところ、高速かつ高精度の最適化が実現できることを確認した。
- 社団法人電子情報通信学会の論文
- 1994-03-11
著者
-
國枝 博昭
東京工業大学理工学研究科集積システム専攻
-
大塚 友彦
東京工業高等専門学校情報工学科
-
大塚 友彦
東京工業高専
-
大塚 友彦
東京工業大学工学部
-
国枝 博昭
東京工大 工
-
国枝 博昭
東京工業大学 電気電子工学科
-
國枝 博昭
東京工業大学
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