3次元座標変換のビットシリアルFPGAへの実装
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概要
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本稿では3次元座標変換のビットシリアルFPGAへの実装について述べる。3次元座標変換では扱う空間が広いため、データの処理に高い精度が要求される。一般的に、浮動小数点での処理が不可欠であるが、その処理の複雑さがハードウエアへの実装を困難にしている。特にFPGAの場合はその資源が限られているため十分な性能を得るのは難しい。我々はこれらの問題を踏まえて、ビットシリアルFPGAに適した浮動小数点の加算器と乗算器のアルゴリズムとアーキテクチャを設計し、それらを基に3次元座標変換の実装をおこなった。浮動小数点加算で約89.3MFLOPS、3次元座標変換で約7.2M vertex/secという結果が得られた。
- 2000-09-07
著者
-
一色 剛
東京工業大学理工学研究科集積システム専攻
-
國枝 博昭
東京工業大学理工学研究科集積システム専攻
-
国枝 博昭
東京工大 工
-
国枝 博昭
東京工業大学 電気電子工学科
-
國枝 博昭
東京工業大学
-
一色 剛
東京工業大学理工学研究科物性物理学
-
太田 章久
東京工業大学工学部電気・電子工学科
-
太田 章久
東京工業大学電気・電子工学科
-
一色 剛
東京工業大学工学部電気・電子工学科
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