実時間通信システムに対する高信頼ハードウェア合成手法の提案(VLSIの設計/検証/テスト及び一般 論理合成及び高位合成)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
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概要
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本稿では,実時間通信システムを複数の機能部品で構成する場合に,コストおよび性能のバランスを考慮しつつ回路を効率よく設計する方法を提案する.提案手法では,実時間システムを,システム全体の性能と各機能部品の性能をパラメタとして用いて並行周期EFSM群としてモデル化する.その際,幾つかの部品の共通化,ある部品の並列化などの部品構成の変更が効率よく行えるモデル化の方法を提案する.記述したシステムの仕様から,パラメトリックモデル検査法により,並行周期EFSM群が指定された時間制約の下でデッドロックすることなく周期的に処理を繰り返し実行できるためのパラメタ間の関係を求め,また,その関係に従い,各種パラメタ値を決めることで,RTレベルのVHDL記述を得ることができるためのツールを開発した.携帯電話端末の基本モジュールの設計・実装を通して,本手法の有用性を確認した.
- 社団法人電子情報通信学会の論文
- 2003-11-21
著者
-
安本 慶一
奈良先端科学技術大学院大学情報科学研究科
-
東野 輝夫
大阪大学大学院情報科学研究科
-
中田 明夫
大阪大学大学院情報科学研究科
-
木谷 友哉
大阪大学大学院情報科学研究科情報ネットワーク学専攻
-
高本 佳史
大阪大学大学院情報科学研究科情報ネットワーク学専攻
-
東野 輝夫
大阪大学大学院情報科学研究科|独立行政法人科学技術振興機構 Crest
-
木谷 友哉
静岡大学 若手グローバル研究リーダー育成拠点
-
安本 慶一
奈良先端科学技術大学院大学
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