高位合成システムにおけるスレッド分割を用いた低消費電力化手法(システムオンシリコン設計技術並びにこれを活用したVLSI)
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概要
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本稿では,高位合成システムにおけるスレッド分割を用いた低消費電力化手法を提案する.提案手法では,並列に動作する回路ブロック(スレッド)を明示的に記述できる高位合成システムを対象とする.あるデータパスを実現するスレッドにおいて,局所的なレジスタに着目し,分割された一方の部分スレッド内のみにそのレジスタが生成されるようにスレッドを分割する.このとき,データの依存関係を保つために同期通信が必要となる.分割した部分スレッドは同期通信のため待機状態を持つ.この待機状態にある部分スレッドに対しGated Clockを適用することで,分割する前に比べ回路面積のオーバーヘッドが少なく効果的に低消費電力化が実現できる.さらに,計算機実験により消費電力が削減されていることを確認する.
- 2003-02-28
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