タイミング制約を考慮した非線形計画に基づくスタンダードセル配置手法
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概要
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本稿では,VLSIチップのレイアウト設計において,与えられたタイミング制約を満たすセル配置手法を提案する.パフォーマンスを考慮する上で配線遅延は無視できないが,本手法では遅延が配線長の2乗に比例する配線遅延モデルを用いる.アルゴリズムでは,まず,タイミング制約を考慮した高速な手法で初期配置を行い,次に,非線形計画法に基づく手法で配置改良をする.この配置改良手法はクリティカルパスの伝搬遅延時間の制約の下で総配線長を最小化する問題を非線形計画法で解く手法である.実用性を考えて,配置改良は制約がクリティカルな部分回路に対して反復して実行される.最後に,タイミングを考慮した列割り当て手法でセルを列状に配置する.
- 一般社団法人情報処理学会の論文
- 1994-02-04
著者
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