データパスレイアウトのための分枝限定法に基づくフロアプランアルゴリズム
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概要
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近年の半導体技術の進展に伴い,チップのデータパス部も大規模化・高速化し複雑さを増している.このため,人手のよるデータパス部のレイアウト設計が困難になってきており,計算機による自動設計が強く望まれている.通常,データパス部では図1のようにセルが格子状に並ぶ.水平方向には同型セルがビット数分並び,1つのブロックを構成する.また,垂直方向には機能の異なるブロックが1列に並ぶ.異なるブロック間のセル同士の配線はビット毎の繰り返しになっており,データパス部のフロアプランニングはトラックオーバフローの最大数を最小とした上で総配線長を最小とするようなブロック1次元配置問題として定式化できる.
- 一般社団法人情報処理学会の論文
- 1992-09-28
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