教育用32ビットマイクロプロセッサQP-DLXの設計における論理合成とテスト生成
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概要
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現在,我々は教育用32ビットマイクロプロセッサQP-DLXの開発を行なっている. QP-DLXの関発はハードウェア記述言語SFLによる設計から設計検証,論理合成,論理圧縮,実部品マッピング, さらにレイアウト,テストベクトル生成,論理シミュレーション,ボード設計までを行なっている.ここではSFL記述で設計されたQP-DLXを論理合成し,論理圧縮,実部品マッピングを経て最終版ネットリストを出力し,レイアウト側ヘ受け渡すまでの過程とテストベクトル生成に関して述べる.論理合成,論理圧縮,実部品マッピングは,CADツールとして, NTTで開発された論理合成システムPARTHENONを使用し,論理回路簡単化プログラムonset(Optimizer for logic Networks Supported by Extension of Transduction method)を適用して面積最小となるよう論理圧縮を行なった.さらにクリテイカルパス圧縮も行なった.実部品マッピングでは,セルライブラリとしてVLSI Technology社のVSC450を用い,スタンダードセルへのマッピングを行なった.テストベクトル生成はCADツールとして, COMPASS Design Automation社のテストベクトル生成ツールSTARを使用し,QP-DLXの観測機能を利用したテストベクトルを生成した.
- 一般社団法人情報処理学会の論文
- 1994-03-07
著者
-
安浦 寛人
九州大学大学院システム情報科学研究院
-
村上 和彰
九州大学大学院システム情報科学府
-
安浦 寛人
九州大学大学院システム情報科学研究科情報工学専攻
-
岩井原 瑞穂
京都大学大学院情報学研究科社会情報学専攻
-
岩井原 瑞穂
九州大学大学院システム情報科学研究院
-
永浦 渉
九州大学大学院総合理工学研究科情報システム学専攻
-
村上 和彰
九州大学大学院 システム情報科学研究院 情報知能工学部
-
安浦 寛人
九州大学大学院 システム情報科学研究院
-
村上 和彰
九州大学大学院 システム情報科学研究院 情報理学部門
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