FPGA化のためのk-ary n-cube型相互結合網用のルータの設計
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概要
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我々は, MIMD超並列計算機向きのルータのFPGA化を前提として, k-ary n-cube型ネットワークの実装方法について検討し, 試みとして16-ary2-cubeの2次元トーラスネットワークルータをXilinx FPGA XC4013PQ240に実装した. k-ary n-cube型ネットワークルータのアーキテクチャには我々の研究室で提案されたTokkyuルータを採用している. このルータは特定方向のパケットをバイパスするPacket Express Wayにより低遅延のルーティングが可能なアーキテクチャを持つ. 本報告では, FPGAヘ実装方法について検討し, その実装の結果について述べるものである.
- 一般社団法人情報処理学会の論文
- 1996-05-16
著者
-
佐野 雅彦
徳島大学総合情報処理センター
-
高橋 義造
徳島大学工学部
-
佐野 雅彦
徳島大学工学部知能情報工学科
-
岡田 智士
徳島大学工学部知能情報工学科
-
栗栖 一洋
徳島大学工学部知能情報工学科
-
杉原 泰次郎
徳島大学工学部知能情報工学科
-
Flavell Andrew.
徳島大学工学部知能情報工学科
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