通信機構に合わせた最適化を行う並列化コンパイラ
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概要
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分散メモリ型の並列計算機では,プロセッサ間の通信がボトルネックにならないように,典型的な通信パターンを高速化する特別なハードウェアを用意しているものがある.我々は並列計算機CP-PACS/Pilot3(日立SR2201)用に,HPFコンパイラのサブセットを開発し,対象計算機が持つ通信用ハードウエアを最大限に活用するコードを生成できるようにした.通信用ハードウェアを最適に利用するためには,プロセッサ間の通信パターンを正確に分析する必要がある.我々はインスペクタ・エグゼキュータを改良した方式を用いることで,これを可能にした.また,我々はベンチマーク・テストによって,開発したコンパイラが生成するコードが実際に高い実行効率を達成していることを確かめた.
- 一般社団法人情報処理学会の論文
- 2001-04-15
著者
-
板野 肯三
筑波大学大学院システム情報工学研究科
-
板野 肯三
筑波大学電子・情報工学系
-
千葉 滋
東京工業大学数理・計算科学専攻
-
千葉 滋
筑波大学電子・情報工学系
-
横田 大輔
筑波大学電子・情報工学系
-
横田 大輔
東京農工大学工学部電子情報工学科
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