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半導体先端テクノロジーズ | 論文
- ポーラスSiOCダイレクトCMP後洗浄における界面活性剤のHLB効果
- 高空孔率(50%)高強度(9GPa)自己組織化ポーラスシリカ膜を用いた32nmノードLSI向け超低誘電率膜(k=2.1)Cuダマシン多層配線(配線・実装技術と関連材料技術)
- 第1回環太平洋プラナリゼーションCMPとその応用技術に関する国際会議2004
- Ruバリアメタル構造のCu配線におけるCu研磨時のガルバニック腐食制御(配線・実装技術と関連材料技術)
- 代替フロン(CF3I)を用いたLow-k膜エッチング技術 (全冊特集 新材料の導入と半導体製造装置)
- A New Plasma-Enhanced Co-Polymerization (PCP) Technology for Reinforcing Mechanical Properties of Organic Silica Low-k/Cu Interconnects on 300 mm Wafers(低誘電率層間膜,配線材料及び一般)
- 自己集合体化技術を用いた超低誘電率多孔質シリカ膜(低誘電率層間膜,配線材料及び一般)
- HfSiON/TiNゲートスタックpMOSFETの陰極電子注入絶縁破壊モデルに基づくTDDB寿命予測方法
- メタルゲート/HfSiONゲート絶縁膜ゲートスタックにおけるピニング現象の改善策検討
- Ru-Mo合金を用いた金属/high-k 絶縁膜ゲートスタックの実効仕事関数制御
- FSP-FLA(Flexibly-Shaped-Pulse FLA)による極浅接合形成とメタル/高誘電率絶縁膜デバイス特性の改善(低電圧/低消費電力技術,新デバイス・回路とその応用)
- (100),(110)基板上High-κ/MetalゲートpMOSFETsのNBTIと1/fノイズ特性の相違に関する考察(低電圧/低消費電力技術,新デバイス・回路とその応用)
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- 高性能,低消費電力を目指すCMOSデバイス構造の今後の発展(極限の微細化を目指す半導体プロセス技術)
- 金属/high-k絶縁膜構造トランジスタにおいて金属結晶が閾値電圧ばらつきに及ぼす影響とその抑制(IEDM特集(先端CMOSデバイス・プロセス技術))
- EUVリソグラフィーを用いた70nmピッチCu/ポーラス低誘電率膜デュアルダマシンインテグレーションの基礎検討(配線・実装技術と関連材料技術)
- XPS/AESによるHfSiOx薄膜の光学的誘電率の推定(ゲート絶縁膜, 容量膜, 機能膜及びメモリ技術)
- XPS時間依存測定法によるHfAlOx薄膜中の電荷捕獲現象の評価(ゲート絶縁膜,容量膜,機能膜及びメモリ技術)
- TCADによる完全空乏型SOIトランジスタ設計(プロセス・デバイス・回路シミュレーション及び一般)
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