Quantitative Evaluation of Resource Sharing in High-level Synthesis Using Realistic Benchmarks
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概要
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For FPGA-based designs generated through high-level synthesis (HLS), effects of resource sharing/unsharing on clock frequency, execution time, and area are quantitatively evaluated for several practically large benchmarks on multiple FPGA devices. Through experiments, we observed five important findings about resource sharing/unsharing, which are contrary to conventional wisdom or have not been sufficiently handled. These five findings will be useful for the further development and advance of the practical HLS technology.
- Information and Media Technologies 編集運営会議の論文
著者
-
Takada Hiroaki
Nagoya Univ.
-
HARA-AZUMI Yuko
Nara Institute of Science and Technology
-
Matsuba Toshinobu
Nagoya University
-
Tomiyama Hiroyuki
Ritsumeikan University
-
Honda Shinya
Nagoya University
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