Simultaneous Allocation and Binding Considering Multiplexers in High-Level Synthesis

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概要

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• This paper proposes a novel simultaneous allocation and binding method in high-level synthesis, which minimizes the circuit area including multiplexers (MUXs) while meeting a constraint on clock period. Contrary to most existing works which focus on minimizing the number of interconnections under given allocation but do not care where MUXs would be inserted, our work takes into account where MUXs would be inserted in a circuit and optimizes not only MUXs but also allocation while meeting a clock constraint. This method is formulated as an ILP problem. Also, an effective ILP-based heuristic for non-small designs is presented. Experimental results demonstrate that our work meets the clock constraint with the minimum circuit area.

• 2011-01-10

著者

• 高田 広章

  豊橋技術科学大学

• 高田 広章

  豊橋技科大

• YukoHara-Azumi

  University of California, Irvine|Research Fellow of the Japan Society for the Promotion of Science|R

• Hiroyuki Tomiyama

  Ritsumeikan University

• Hiroaki Takada

  Nagoya University

• 高田 広章

  名古屋大学大学院情報科学研究科附属組込みシステム研究センター|名古屋大学大学院情報科学研究科情報システム学専攻

• Takada Hiroaki

  Nagoya Univ.

• 高田 宏章

  豊橋技術科学大学情報工学系

• 高田 広章

  名古屋大学 大学院情報科学研究科

• 高田 広

  東京大学理学部

• 高田 広章

  名古屋大 大学院情報科学研究科 組込みシステム研究セ

• 高田 広章

  東大・理

• 高田 広章

  Nagoya University

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