差動重複入力に基づく9ビット/10MSps逐次比較ADCの開発(システムLSIの応用と要素技術,プロセッサ,DSP,画像処理技術及び一般)
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概要
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本研究では、1.2V 9ビット/10MSps逐次比較型ADCを高精度化するためのプリチャージ方法を提案する。提案する変換メカニズムは電源電圧の2倍の入力範囲を達成する。我々は、動的なコンパレータに特別な設計を施し、またプレ変換における分配ステージ前に追加比較を導入する。65nm CMOSプロセスにおける設計した回路のシミュレーション結果では、INLとDNLはそれぞれ0.05と0.035LBで、総消費電力は0.504mWであった。
- 2012-10-11
著者
-
楊 波
北九州市立大学国際環境工学部情報メディア工学科
-
中武 繁寿
北九州市立大学 大学院 国際環境工学研究科
-
董 青
北九州市立大学大学院 国際環境工学研究科
-
李 静
北九州市立大学国際環境工学部
-
董 青
北九州市立大学国際環境工学部
-
陳 功
北九州市立大学大学院国際環境工学研究科
-
張 宇
北九州市立大学大学院国際環境工学研究科
-
陳 功
北九州市立大学大学院国際環境研究科
-
楊 波
(株)設計アルゴリズム研究所
-
李 静
(株)設計アルゴリズム研究所
-
中武 繁寿
北九州市立大学
-
張 宇
北九州市立大学大学院 国際環境研究科
-
陳 功
北九州市立大学大学院 国際環境研究科
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