高速データバスに接続されたFPGAにおけるHWボトルネックを解消するための設計フレームワーク(設計フレームワーク)
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概要
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PCI-Expressインターフェイスを搭載するリコンフィギャラブル・デバイスの登場などにより,CPUやメモリとリコンフィギャラブル・デバイス間のデータ転送速度が高くなった.しかしながら,ハードウェアの処理時間がデータ転送時間より長い場合,データ転送を一時停止させる必要がある.その結果,高速なデータ転送技術を用いても十分な性能を引き出すことができない.そこで,本稿ではデータ並列性をもつループを対象とし,高いデータ転送速度を維持してリコンフィギャラブル・デバイスでハードウェア処理を行うハードウェア構成を生成するフレームワークを提案する.実装評価により,提案フレームワークから生成されたハードウェア構成は高いデータ転送速度でハードウェア処理を実現できることを示す.
- 2011-09-19
著者
-
井口 寧
北陸先端科学技術大学院大学
-
井口 寧
北陸先端科学技術大学院大学情報科学センター
-
荒木 光一
北陸先端科学技術大学院大学情報科学研究科
-
佐藤 幸紀
北陸先端科学技術大学院大学情報社会基盤研究センター
-
佐藤 幸紀
北陸先端科学技術大学院大学情報社会基盤センター
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