テスト容易な並列プレフィックス加算器の設計手法(設計/テスト/検証,設計/テスト/検証)
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概要
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並列プレフィックス加算器をテスト容易化する設計手法を提案する.並列プレフィクス加算器は,最下位から各桁までの桁上げ生成条件と伝搬条件を計算するプレフィクス計算を並列に行う.プレフィクス計算部の構成に自由度があり,計算時間や面積などの要求に合った構成が可能である.テストのための入力線を1本付加するとともに,加算器を構成する4種類の基本セルの機能を若干変更することにより,単一セル機能故障の仮定の下で,nビット加算器が24n-2個のパターンによりテスト可能となる.
- 2009-06-12
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