乗算器および除算器IPの開発
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概要
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大学でIP(Intellectual Property)として利用されることを目指し,乗算器および除算器を設計した.乗算器は32ビットの整数を対象とし,回路段数が最小となるWallace木に基づく回路構成と,回路段数は若干増えるが規則正しい構造を持つOvertured-Stairs木に基づく回路構成の二つを設計し評価した.除算器はIEEE754単精度基本フォーマットの仮数部の計算を対象とし,基数2と基数4,および基数2の桁選択をオーバラップした減算シフト型除算器の設計を行った.また,これらの除算器にリタイミングを採用した除算器も設計した.
- 社団法人電子情報通信学会の論文
- 2002-11-21
著者
-
篠原 正行
名古屋大学 大学院 工学研究科 情報工学
-
高木 一義
名古屋大学大学院情報科学研究科
-
高木 直史
名古屋大学大学院情報科学研究科
-
高木 一義
名古屋大学
-
高木 直史
名古屋大学
-
水野 知秀
名古屋大学大学院 工学研究科 情報工学
-
水野 知秀
名古屋大学 大学院 工学研究科 情報工学
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