浮動小数点ユークリッドノルム計算回路
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概要
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三つの浮動小数点数で与えられる3次元ベクトルのユークリッドノルムを計算する回路の設計と評価について述べる.以前提案したハードウェアアルゴリズムの改良を行い,それに基づく回路を設計する.回路の入出力はIEEE754浮動小数点標準の基本フォーマットとする.回路は,前処理回路,仮数部計算回路,正規化回路で構成する.仮数部計算回路については3種類の構成を示す.けた合せ処理を仮数部計算と統合することにより,回路全体のハードウェア量を削減する手法を提案する.回路の評価の結果,提案した手法により,回路全体の面積を約20%削減することができた.平方算3回,加算2回,開平算1回に相当するユークリッドノルム計算を行う回路が,開平器に比べ,約1.5倍の遅延,約2倍の面積,約2倍の計算時間で実現できることが明らかになった.
- 社団法人電子情報通信学会の論文
- 2003-04-01
著者
-
高木 一義
名古屋大学大学院情報科学研究科
-
高木 直史
名古屋大学大学院情報科学研究科
-
熊澤 文雄
名古屋大学大学院情報科学研究科情報システム学専攻
-
高木 一義
名古屋大学
-
高木 直史
名古屋大学
-
武内 大輔
名古屋大学大学院工学研究科情報工学
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