順序回路の形式的検証におけるフォールスネガティブ削減のための回路変換(システム設計・高位論理設計,システムオンシリコンを支える設計技術)
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概要
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本研究では、回路変換を行うことにより、本来初期状態から到達不能であるため仕様違反ではない動作を誤検出されないように変更することで、フォールスネガティブを削減する手法を提案する。本手法では、回路が正しい動作をしている間は常に成り立っている不変条件が成り立たない到達不能状態において、誤検出が発生することに着目する。これにより、誤検出が減ることで、検証の高速化が期待できる。
- 2010-03-03
著者
-
中村 一博
名古屋大学大学院情報科学研究科
-
高木 一義
名古屋大学大学院情報科学研究科
-
高木 直史
名古屋大学大学院情報科学研究科
-
高木 直史
名古屋大学大学院情報科学研究科情報システム学専攻
-
高本 直史
名古屋大学
-
尾野 紀博
名古屋大学大学院情報科学研究科
-
高木 直史
名古屋大学情報科学研究科
-
高木 一義
名古屋大学
-
高木 直史
名古屋大学
-
中村 一博
名古屋大学
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