二段階検証による順序回路の限定モデル検査の高速化手法(論理設計2,システムオンシリコンを支える設計技術)
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概要
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本研究では、回路に関する付加情報を用いてSAT-Solverの処理時間を短縮することで、限定モデル検査の高速化をはかる手法を提案する。付加情報とは、回路設計者などが持つ、設計された回路のデータパス部や制御パス部に関する情報のことである。提案する付加情報を用いた限定モデル検査手法では、二段階で検証を行う。一段階目で、付加情報と検証対象回路の間に矛盾がないことを示し、二段階目で、従来の限定モデル検査において、付加情報に関するCNF式を追加した上で検証を行う。実験結果から、66個の検証のうち54個で提案手法による高速化が確認できた。
- 2011-02-23
著者
-
中村 一博
名古屋大学大学院情報科学研究科
-
高木 一義
名古屋大学大学院情報科学研究科
-
高木 直史
名古屋大学大学院情報科学研究科情報システム学専攻
-
高木 一義
名古屋大学大学院情報科学研究科:戦略的創造研究推進事業
-
高本 直史
名古屋大学
-
尾野 紀博
名古屋大学大学院情報科学研究科
-
高木 直史
名古屋大学情報科学研究科
-
高木 一義
名古屋大学
-
高木 直史
名古屋大学
-
中村 一博
名古屋大学
-
高木 直史
京都大学大学院:crest-jst
-
高木 直史
京都大学大学院
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