高木 直史 | 名古屋大学
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概要
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高木 直史
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高木 直史
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高木 一義
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高木 一義
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高本 直史
名古屋大学
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藤巻 朗
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田中 雅光
名古屋大学
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中村 一博
名古屋大学大学院情報科学研究科
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吉川 信行
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Yoshikawa N
Yokohama National Univ. Yokohama Jpn
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川島 裕崇
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川島 裕崇
名古屋大学大学院 情報科学研究科 情報システム学専攻
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赤池 宏之
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赤池 宏之
名古屋大学
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熊澤 文雄
名古屋大学大学院情報科学研究科情報システム学専攻
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横浜国立大学工学府
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名古屋大学大学院情報科学研究科
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山梨 裕希
横浜国立大学工学府
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高木 直史
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貝沼 世樹
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朴 熙中
横浜国立大学
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カタエバ イリナ
名古屋大学:戦略的創造研究推進事業
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島村 泰浩
横浜国立大学大学院
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長瀬 哲也
名古屋大学大学院情報科学研究科
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名古屋大学:戦略的創造研究推進事業
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成瀬 智啓
名古屋大学大学院情報科学研究科
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朴 煕中
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矢島 脩三
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村上 和彰
九州大学:戦略的創造研究推進事業
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北海道大学情報基盤センター
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神谷 義章
名古屋大学大学院工学研究科
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京都大学工学部
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矢島 脩三
京都大学大学院工学研究科情報工学教室
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原 浩史
横浜国立大学工学部電子情報工学科
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伊藤 将人
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島崎 亮
名古屋大学大学院情報科学研究科
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名古屋大学大学院情報科学研究科
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Kataeva Irina
名古屋大 大学院工学研究科
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大橋 岳洋
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Murakami K
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名古屋大学大学院工学研究科情報工学専攻
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九州大学大学院システム情報科学府
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藤原 完
超電導工学研究所:日本学術振興会
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渡辺 恭章
名古屋大学大学院工学研究科情報工学
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秋本 彩
横浜国立大学
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河本 智浩
名古屋大学
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河本 智浩
名古屋大学大学院工学研究科
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永沢 秀一
超電導工学研
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笠木 諒
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岡田 将和
名古屋大学:戦略的創造研究推進事業
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村上 和彰
九州大学 情報基盤センター
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藤原 完
超電導工学研
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矢島 脩三
京都大学工学研究科情報工学専攻
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浅田 啓一
名古屋大学大学院情報科学研究科
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日高 睦夫
超電導工学研究所
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鈴木 秀俊
名古屋大学大学院工学研究科
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篠原 正行
名古屋大学 大学院 工学研究科 情報工学
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入江 直樹
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岩崎 真悟
名古屋大学
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佐藤 元紀
名古屋大学大学院情報科学研究科
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藤原 完
横浜国立大学大学院工学府
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日高 睦夫
財)国際超電導産業技術研究センター
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高木 克巳
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竹島 将太
名古屋大学
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伊藤 雅之
京都大学工学部情報工学教室
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松岡 大輔
名古屋大学大学院工学研究科計算理工学専攻
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木村 晋二
奈良先端科学技術大学院大学情報科学研究科
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鈴木 秀俊
名古屋大学大学院情報科学研究科情報システム学専攻
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鬼頭 秀明
名古屋大学大学院工学研究科情報工学専攻
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南 利明
名古屋大学大学院工学研究科情報工学専攻
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竹島 将太
名古屋大学大学院情報科学研究科
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日高 睦夫
国際超電導産業技術研究セ
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岩崎 真悟
名古屋大学:戦略的創造研究推進事業
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高木 克巳
名古屋大学:戦略的創造研究推進事業
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伊藤 雅之
京都大学工学部情報工学科
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藤巻 朗
名古屋大 大学院
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永沢 秀一
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水野 知秀
名古屋大学大学院 工学研究科 情報工学
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花井 健輔
名古屋大学大学院情報科学研究科
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Kaihara Marcelo
名古屋大学大学院工学研究科
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門脇 俊介
名古屋大学大学院 情報科学研究科 情報システム学
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水野 知秀
名古屋大学 大学院 工学研究科 情報工学
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日野出 憲治
超電導工学研究所
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佐藤 哲朗
超電導工学研究所
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北川 佳廣
超電導工学研究所
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早川 尚夫
名古屋大学工学研究科
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中島 直希
横浜国立大学大学院工学府
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近藤 敏明
名古屋大学大学院工学研究科
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早川 尚夫
名古屋大学
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尾野 紀博
名古屋大学大学院情報科学研究科
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北川 佳廣
超電導工学研究所:crest-jst
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日野出 憲治
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早川 尚夫
名古屋大
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早川 尚夫
名古屋大学工学部
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武内 大輔
名古屋大学大学院工学研究科情報工学
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近藤 敏明
名古屋大学
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Kaihara Marcelo
名古屋大学大学院工学研究科情報工学
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カタエバ イリナ
名古屋大学大学院工学研究科:科学技術振興機構・戦略的創造研究推進事業
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川口 隆広
名古屋大学大学院情報科学研究科
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高木 一義
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小川 雄史
名古屋大学大学院工学研究科情報工学専攻
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堀山 貴史
埼玉大学大学院理工学研究科
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堀山 貴史
京都大学大学院情報学研究科
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堀山 貴史
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堀山 貴史
京都大学大学院 工学研究科
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加藤 慎也
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田代 善彦
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藤原 完
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永沢 秀一
財団法人国際超電導産業技術研究センター超電導工学研究所
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日高 睦夫
財団法人国際超電導産業技術研究センター超電導工学研究所
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田中 優
福井大学大学院工学研究科
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鳥居 洸佑
名古屋大学工学部
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鈴木 英利
横浜国立大学工学部電子情報工学科
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五十嵐 正憲
横浜国立大学工学部電子情報工学科
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夏目 侑紀
横浜国立大学工学部電子情報工学科
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伊藤 啓太
名古屋大学
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高木 直史
名古屋大学工学部情報工学科
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藤井 真一
名古屋大学情報科学研究科
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中林 直生
名古屋大学大学院情報科学研究科
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岩垂 好裕
名古屋大学工学部情報工学科
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古田 卓也
名古屋大学大学院情報科学研究科
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田中 務光
名古屋大学
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高井 昌影
北海道大学
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田中 雅光
名古屋大学大学院情報科学研究科情報システム学専攻
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大野 真司
名古屋大学大学院情報科学研究科情報システム学専攻
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本田 宏明
九州先端科学技術研究所
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井上 弘士
九州大学システム情報科学研究院
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村上 和彰
九州大学システム情報科学研究院
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平 重喜
名古屋大学大学院工学研究科
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本田 宏明
九州大学情報基盤研究開発センター
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加藤 慎也
名古屋大学大学院工学研究科情報工学専攻
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秋山 博
名古屋大学大学院工学研究科
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矢島 脩三
京都大学 工学部
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田中 優
名古屋大学大学院工学研究科
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藤吉 靖浩
京都大学
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岩垂 好俗
名古屋大学大学院工学研究科
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樋口 明
名古屋大学大学院工学研究科情報工学専攻
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西海 尚伸
横浜国立大学大学院工学府
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濱野 貴文
京都大学 工学部 情報工学科
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プレパラータ フランコ
Dept. of Computer Science, Brown University
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澤田 有生
名古屋大学大学院工学研究科計算理工学専攻
-
プレパラータ フランコ
Dept. Of Computer Science Brown University
-
吉識 順一
名古屋大学大学院工学研究科情報工学専攻
-
広田 和也
名古屋大学大学院工学研究科情報工学専攻
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岡本 圭太
名古屋大学工学部工学研究科電気電子情報工学科情報工学コース
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鈴木 英利
横浜国立大学工学府
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Kaihara M
名古屋大学大学院工学研究科
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小林 謙太
名古屋大学大学院情報科学研究科
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柴岡 雅之
名古屋大学工学部電気電子情報工学科
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日高 一輝
名古屋大学大学院情報科学研究科
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大野 真司
名古屋大学大学院 情報科学研究科 情報システム学専攻
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Kaiharai Marcelo
名古屋大学大学院工学研究科情報工学
-
岩垂 好裕
名古屋大学大学院工学研究科
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E. Kaihara
名古屋大学大学院工学研究科情報工学
-
高木 一義
京都大学大学院情報学研究科
著作論文
- 超伝導単一磁束量子集積回路の技術動向と超伝導コンピュータの展望
- 複合算術演算の減算シフト型ハードウェアアルゴリズムの設計支援(VLSI設計技術とCAD)
- Nbアドバンストプロセスを用いた単一磁束量子浮動小数点演算器の設計(ディジタル,一般)
- テスト容易な並列プレフィックス加算器の設計手法(設計/テスト/検証,設計/テスト/検証)
- SFQ半精度浮動小数点乗算器の設計と試作(デジタル,一般)
- 投票無衝突化手法を用いた小面積画素並列ハフ変換回路(応用,組込技術とネットワークに関するワークショップETNET2009)
- SFQ半精度浮動小数点加算器の設計と試作(デジタル,一般)
- C-8-10 SFQ浮動小数点乗算器の同期化および動作実証(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-13 Nb多層プロセスを用いて試作したシフトレジスタの測定評価(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-7 超伝導SFQ回路のための新Nb多層プロセス(C-8. 超伝導エレクトロニクス,一般セッション)
- オペランドの和を利用した小面積乗算器(演算器最適化,デザインガイア2008-VLSI設計の新しい大地)
- オペランドの和を利用した小面積乗算器(演算器最適化,デザインガイア2008-VLSI設計の新しい大地-)
- 全加算器で構成したマルチオペランド加算器のテスト生成(設計/テスト/検証)
- Nb多層デバイス構造用セルライブラリに向けた最適なモート構造の検討(単一磁束量子大規模集積回路技術の現状と将来展望、デジタル応用及び一般)
- パイプライン動作を考慮した単一磁束量子回路のための論理設計検証手法(ディジタル,一般)
- テスト容易な並列プレフィックス加算器の自動合成手法の検討(ディペンダブルシステム,組込み技術とネットワークに関するワークショップ ETNET2010)
- 投票高々1衝突化手法を用いた小面積画素並列ハフ変換回路の設計 (ディペンダブルコンピューティング)
- 投票高々1衝突化手法を用いた小面積画素並列ハフ変換回路の設計 (VLSI設計技術)
- オペランドの和を用いた並列乗算器の消費エネルギー評価(論理設計,デザインガイア2009-VLSI設計の新しい大地-)
- A-3-1 Sequential SATの高速化のためのm-Trieを用いた時間フレームを跨いだ状態併合(A-3.VLSI設計技術,一般セッション)
- C-8-14 可変遅延素子を用いた単一磁束量子可変長シフトレジスタ(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-6 10kA/cm^2Nbプロセス用単一磁束量子セルライブラリの構築(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-7 単一磁束量子回路を用いた2並列3段の再構成可能なデータパスの検討(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-9 A^*アルゴリズムに基づく単一磁束量子回路受動線路配線ツールの実装と評価(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-10 2並列4段の再構成可能なデータパスを有する単一磁束量子回路の検討(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-12 SFQ半精度浮動小数点乗算器の試作と動作実証(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-21 単一磁束量子回路における2並列2段の再構成可能なデータパスの動作実証(C-8. 超伝導エレクトロニクス,一般セッション)
- C-8-18 SFQ半精度浮動小数点乗算器の設計と試作(C-8. 超伝導エレクトロニクス,一般セッション)
- C-8-16 アドバンストプロセス2.1を用いた2並列2段のSFQ-RDPの検討(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-15 10kA/cm^2Nbアドバンスドプロセスを用いたSFQ半精度浮動小数点乗算器の設計(C-8.超伝導エレクトロニクス,一般セッション)
- A-20-20 TLDP法の並列化による省メモリな連続単語音声認識回路(A-20. スマートインフォメディアシステム,一般セッション)
- A-3-11 テスト容易な並列プレフィックス加算器の設計(A-3. VLSI設計技術,一般セッション)
- C-8-5 10kA/cm^2Nbプロセスを用いたSFQ半精度浮動小数点加算器のコンポーネント回路の設計(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-2 単一磁束量子回路による冗長2進表現を用いたシストリックシリアル指数計算回路(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-1 単一磁束量子回路のためのパイプライン検証手法(C-8.超伝導エレクトロニクス,一般セッション)
- けた上げ保存加算器で構成された部分積加算部をもつ乗算器のテスト(ディペンダブルコンピューティング)
- C-8-13 SFQ回路のためのレイアウトを考慮したスキューのあるクロック木の構成法(C-8.超伝導エレクトロニクス,一般セッション)
- 平方根の逆数計算回路の設計と評価
- 平方根の逆数計算回路の設計と評価
- 平方根の逆数計算回路の設計と評価
- Steinのアルゴリズムに基づく有限体上の除算アルゴリズム
- Steinのアルゴリズムに基づく有限体上の除算アルゴリズム
- Steinのアルゴリズムに基づく有限体上の除算アルゴリズム
- 投票高々1衝突化手法を用いた小面積画素並列ハフ変換回路の設計
- 再構成可能なデータパスに向けた単一磁束量浮動小数点除算器の実証(単一磁束量子大規模集積回路技術の現状と将来展望、デジタル応用及び一般)
- C-8-22 単一磁束量子回路のフロアプラン設計支援に向けた配線遅延時間の推定(C-8. 超伝導エレクトロニクス,一般セッション)
- C-8-11 パイプライン導入による単一磁束量子浮動小数点加算器の性能向上(C-8.超伝導エレクトロニクス,一般講演)
- C-8-10 シストリックアーキテクチャに基づく高スループットSFQビットシリアル浮動小数点乗算器(C-8.超伝導エレクトロニクス,一般講演)
- C-8-9 単一磁束量子回路による冗長2進表現を用いたシストリック開平器の設計(C-8.超伝導エレクトロニクス,一般講演)
- C-8-11 冗長2進表現を用いたシストリックSFQ除算器(C-8.超伝導エレクトロニクス,一般講演)
- A-3-10 単一磁束量子ディジタル回路のためのone-hot状態割り当てを用いた順序回路の構成法(A-3.VLSI設計技術,一般講演)
- C-8-15 トルネードアーキテクチャに基づく単一磁束量子マイクロプロセッサのALUの改善(C-8.超伝導エレクトロニクス,一般講演)
- C-8-12 トルネードアーキテクチャにおけるSFQマイクロプロセッサのデータパスの動作実証(C-8.超伝導エレクトロニクス,一般講演)
- C-8-10 トルネードアーキテクチャにおけるSFQマイクロプロセッサのデータパスの設計(C-8.超伝導エレクトロニクス,エレクトロニクス2)
- C-8-9 クロック同期式SFQ回路のクロック木合成(C-8.超伝導エレクトロニクス,エレクトロニクス2)
- C-8-5 SFQマイクロプロセッサに向けたレジスタファイルの実証(C-8. 超伝導エレクトロニクス, エレクトロニクス2)
- C-8-12 SFQマイクロプロセッサに向けたトルネードアーキテクチャの提案(C-8.超伝導エレクトロニクス)
- 順序回路の形式的検証におけるフォールスネガティブ削減のための回路変換(システム設計・高位論理設計,システムオンシリコンを支える設計技術)
- C-8-4 SFQ回路実現に向いた直並列型2の補数乗算器(C-8. 超伝導エレクトロニクス, エレクトロニクス2)
- C-8-10 SFQマイクロプロセッサに用いるコンパレータの設計(C-8.超伝導エレクトロニクス)
- 多層配線単一磁束量子回路のための自動配線手法(単一磁束量子大規模集積回路技術の現状と将来展望、デジタル応用及び一般)
- 保存型一括並列処理による高速なHMM出力確率計算・最尤推定回路の構成法
- 保存型一括並列処理による高速なHMM出力確率計算・最尤推定回路の構成法
- 保存型一括並列処理による高速なHMM出力確率計算・最尤推定回路の構成法
- 保存型一括並列処理による高速なHMM出力確率計算・最尤推定回路の構成法
- 単一磁束量子論理回路のための故障モデルとテストパターン生成手法の検討(信号処理基盤技術及びその応用,一般)
- バイアス電源の高電圧化による単一磁束量子回路の高速化の検討(信号処理基盤技術及びその応用,一般)
- 10kA/cm^2プロセスを用いた2並列2段単一磁束量子再構成可能なデータパスの動作実証(超伝導エレクトロニクス基盤技術及び一般)
- 再構成可能部を持つJavaプロセッサにおけるハードウェアJIT機構の検討
- 再構成可能部を持つJavaプロセッサにおけるハードウェアJIT機構の検討
- A-3-16 再構成可能部を持つJavaプロセッサにおける高速化方式およびハードウェアJIT方式の検討
- 10kA/cm^2Nb Processを用いたSFQ浮動小数点乗算器の50GHzでの動作評価(信号処理基盤技術及びその応用,一般)
- C-8-15 10kA/cm^2Nb Processを用いたSFQ浮動小数点乗算器コンポーネント回路の動作評価(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-14 10kA/cm^2Nbプロセスを用いたSFQ半精度浮動小数点加算器のコンポーネント回路の動作実証(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-12 アドバンストプロセスを用いたSFQ-RDP用コンポーネント回路の動作評価(C-8.超伝導エレクトロニクス,一般セッション)
- D-10-10 乗算器の種々の部分積加算部の順序故障テスト(D-10. ディペンダブルコンピューティング,一般セッション)
- 5H-8 立方根計算のハードウェアアルゴリズムについて
- 機能メモリを用いた動画像圧縮のための動きベクトル検出アルゴリズム
- 乗算型除算および開平のためのハードウェアによる初期近似手法
- 除算と開平のための積和演算を用いた初期近似手法
- 連分数展開に基づく高速開平アルゴリズム
- A-3-11 パリティ検査符号を用いたオンライン誤り検出可能な高速加算器(A-3. VLSI設計技術)
- 加算器の平均スイッチングエネルギーの解析的評価(低電力設計と回路設計技術,システムオンシリコンを支える設計技術)
- GF (2^m) 上の繰り返し乗算の高速化のための冗長基底とそれを用いた並列乗算器
- A-7-12 Fast addition for elliptic curve arithmetic in GF(2^n) using projective coordinates
- 剰余除算用ハードウェアアルゴリズムについて
- 乗算器および除算器IPの開発
- 乗算器および除算器IPの開発
- 乗算器および除算器IPの開発
- 算術演算のための減算シプト型ハードウェアアルゴリズムの自動合成(アルゴリズム)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会)
- 算術演算のための減算シフト型ハードウェアアルゴリズムの自動合成(アルゴリズム)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- 算術演算のための減算シフト型ハードウェアアルゴリズムの自動合成(アルゴリズム)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- 算術演算のための減算シフト型ハードウェアアルゴリズムの自動合成(アルゴリズム)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- 浮動小数点ユークリッドノルム計算回路
- A-3-1 3D ユークリッドノルムの逆数計算のハードウェアアルゴリズム
- LC-2 浮動小数点3Dユークリッドノルム計算回路の設計と評価(C. アーキテクチャ・ハードウェア)
- 浮動小数点3Dユークリッドノルム計算回路
- 浮動小数点3Dユークリッドノルム計算回路
- 浮動少数点3Dユークリッドノルム計算回路
- 冗長2進表現を用いた右シフト剰余除算のハードウェアアルゴリズム
- BDDに基づくSFQ論理回路の新しい実現方法(エレクトロニクス・一般)
- 専用回路を用いたマイクロプロセッサにおけるパーミュテーションの高速化(コデザイン及びアーキテクチャ)
- 専用回路を用いたマイクロプロセッサにおけるパーミュテーションの高速化(コデザイン及びアーキテクチャ)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- 専用回路を用いたマイクロプロセッサにおけるパーミュテーションの高速化(コデザイン及びアーキテクチャ)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- 専用回路を用いたマイクロプロセッサにおけるパーミュテーションの高速化(コデザイン及びアーキテクチャ)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- 専用回路を用いたマイクロプロセッサにおけるパーミュテーションの高速化
- セル遅延モデルを用いた算術演算回路の信号遷移回数見積もり手法(システム設計・高位論理設計,システムオンシリコンを支える設計技術)
- TLDP法のパイプライン化による省メモリな連続単語音声認識回路
- TLDP法のパイプライン化による省メモリな連続単語音声認識回路
- 上位からの時差入力下での最適並列加算器
- C-8-10 単一磁束量子回路を用いた浮動小数点加算器の検討(C-8.超伝導エレクトロニクス,一般講演)
- 乗除べき乗算のための段数 O((1-α)/α n)) 素子数 O((n^)/(αlogn))回路
- A-3-6 Sequential SATにおける時間フレームを跨いだ状態併合(A-3.VLSI設計技術,一般セッション)
- 論理回路のSATベース形式的検証の高速化のためのBDDを用いたCNF式生成手法(検証)
- 論理回路のSATベース形式的検証の高速化のためのBDDを用いたCNF式生成手法(検証)
- 論理回路のSATベース形式的検証の高速化のためのBDDを用いたCNF式生成手法(検証,組込技術とネットワークに関するワークショップETNET2007)
- 論理回路のSATベース形式的検証の高速化のためのBDDを用いたCNF式生成手法(検証,組込技術とネットワークに関するワークショップETNET2007)
- 減算シフト型立方根計算回路
- 減算シフト型立方根計算回路
- 減算シフト型立方根計算回路
- 単一磁束量子回路による再構成可能な大規模データパスをもつプロセッサ(ディジタル・一般)
- オペランドの和を用いた並列乗算器の消費エネルギー評価(論理設計,デザインガイア2009-VLSI設計の新しい大地)
- 部分積加算における信号遷移回数の削減による配列型乗算器の低消費エネルギー化設計(消費電力2,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)
- 部分積加算における信号遷移回数の削減による配列型乗算器の低消費エネルギー化設計(消費電力2,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)
- 部分積加算における信号遷移回数の削減による配列型乗算器の低消費エネルギー化設計(消費電力2,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)
- A-3-5 拡張ユークリッド法に基づくGF(2^m)上の除算回路の剰余計算並列化による高速化(A-3.VLSI設計技術,一般セッション)
- A-3-7 GF(2^m)上の乗除算器のためのハードウェアアルゴリズム(A-3.VLSI設計技術,一般講演)
- A-3-6 素数判定のための試行除算回路(A-3.VLSI設計技術,一般講演)
- 冗長2進数の絶対値計算を用いた整数除算回路(システム設計及び一般)
- 拡張ユークリッド法に基づく剰余系乗除算回路(システム設計及び一般)
- 冗長2進数の絶対値計算を用いた整数除算回路(システム設計及び一般)
- 拡張ユークリッド法に基づく剰余系乗除算回路(システム設計及び一般)
- A-3-12 冗長2進数の絶対値計算を用いた減算シフト型整数除算回路(A-3. VLSI設計技術)
- 剰余系乗除算回路
- 剰余系乗除算回路
- 剰余系乗除算回路
- 算術演算回路のレイアウトのためのビットスライス構造の抽出
- 算術演算回路のレイアウトのためのビットスライス構造の抽出
- A-3-15 バイナリ法に基づくGF(2^m)上の除算のVLSIアルゴリズム
- 配線遅延を考慮した回路モデル上での加算及び乗算の計算複雑さ
- 2×2-Joinを用いた二線式RSFQ論理回路の設計手法(超伝導エレクトロニクス)
- 決定グラフを用いた二線式単一磁束量子回路の論理設計法 (計算機科学基礎理論の新展開)
- C-8-1 二分決定グラフを用いた二線式単一磁束量子回路の論理設計法(C-8.超伝導エレクトロニクス)
- C-8-11 単一磁束量子回路における二線式論理を用いた加算器及び比較器の設計
- オペランドの和を利用した小面積乗算器(演算器最適化,デザインガイア2008-VLSI設計の新しい大地)
- A-3-6 Chen-Willonerアルゴリズムに基づく小面積並列乗算器について(A-3.VLSI設計技術,一般セッション)
- Karatsubaアルゴリズムに基づく小面積乗算器(VLSI設計技術とCAD)
- 配線層数の乗算器の回路面積への影響について(演算回路/専用回路,システムオンシリコン設計技術並びにこれを活用したVLSI)
- 配線層数の乗算器の回路面積への影響について(演算回路/専用回路,システムオンシリコン設計技術並びにこれを活用したVLSI)
- A-3-8 Karatsuba乗算器の設計と評価(A-3.VLSI設計技術,一般講演)
- k回読みl変数順序ブロック化分岐プログラムの計算能力について
- A-3-7 剰余計算並列化によるGF(2^m)上の高速拡張モンゴメリ乗算器(A-3.VLSI設計技術,一般セッション)
- A-3-13 次元数とフレーム数の変化に対応可能なHMM回路(A-3. VLSI設計技術)
- C-8-13 10 kA/cm^2 Nbプロセスを用いたSFQ-RDPの45GHz動作(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-12 ISTEC 10 kA/cm^2 Nbプロセスを用いた単一磁束量子浮動小数点乗算器の改良と動作評価(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-17 単一磁束量子回路のためのマルチサイクルパスを考慮した遅延素子削減手法(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-16 SFQ論理回路のタイミング明示化表現法と論理シミュレーション(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-15 クロック入力が不要な論理ゲートを用いたSFQ論理回路の構成法(C-8.超伝導エレクトロニクス,一般セッション)
- A-20-1 投票無衝突化と投票空間アクセス局所化による小面積画素並列ハフ変換回路(A-20.スマートインフォメディアシステム,一般セッション)
- 多重高速保存型一括並列処理による省メモリな音声認識用HMM計算回路
- 多重高速保存型一括並列処理による省メモリな音声認識用HMM計算回路
- A-3-14 三次元ベクトルのユークリッド・ノルム計算回路の設計
- 投票無衝突化手法を用いた小面積画素並列ハフ変換回路(応用,組込技術とネットワークに関するワークショップETNET2009)
- 投票無衝突化手法を用いた小面積画素並列ハフ変換回路(応用,組込技術とネットワークに関するワークショップETNET2009)
- 投票無衝突化手法を用いた小面積画素並列ハフ変換回路(応用,組込技術とネットワークに関するワークショップETNET2009)
- 投票メモリへのアクセスを局所化した並列ハフ変換回路の構成法(応用,組込技術とネットワークに関するワークショップETNET2008)
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- 投票メモリへのアクセスを局所化した並列ハフ変換回路の構成法(応用,組込技術とネットワークに関するワークショップETNET2008)
- 投票メモリへのアクセスを局所化した並列ハフ変換回路の構成法(応用,組込技術とネットワークに関するワークショップETNET2008)
- 種々の部分積加算構造をもつテスト容易な乗算器の設計手法(ディペンダブルコンピューティング)
- 種々の部分積加算構造に対応したテスト容易な乗算器の設計手法(テスト設計とテスト容易化,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)
- 種々の部分積加算構造に対応したテスト容易な乗算器の設計手法(テスト設計とテスト容易化,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)
- 種々の部分積加算構造に対応したテスト容易な乗算器の設計手法(テスト設計とテスト容易化,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)
- 4-2加算木を用いたテスト容易な乗算器(演算回路/専用回路,システムオンシリコン設計技術並びにこれを活用したVLSI)
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- C-8-9 SFQ回路のための配線面積を考慮したセルベース自動配置配線手法(C-8.超伝導エレクトロニクス,一般講演)
- 3次元ベクトルのユークリッドノルム計算のハードウェアアルゴリズム
- 3次元ベクトルのユークリッドノルム計算のハードウェアアルゴリズム
- 3次元ベクトルのユークリッドノルム計算のハードウェアアルゴリズム
- 3次元ベクトルのノルム計算の減算シフト型アルゴリズムについて
- ユークリッド距離計算用ハードウェアアルゴリズム
- 二段階検証による順序回路の限定モデル検査の高速化手法(論理設計2,システムオンシリコンを支える設計技術)
- 単一磁束量子論理回路のためのタイミング故障のモデル化とテスト手法の検討(ディペンダブルシステム,組込み技術とネットワークに関するワークショップETNET2011)
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- 多層配線単一磁束量子回路のための遅延余裕割り当てに基づく配線順序を考慮した配線手法(物理設計,システムオンシリコンを支える設計技術)
- A-6-1 On a fast algorithm for multiplicative inversion in GF (2^m) using normal basis
- DS-1-7 配線遅延を考慮した回路モデル上での算術演算の計算複雑さ(DS-1. COMP学生シンポジウム,シンポジウムセッション)
- 配線遅延を考慮した回路モデル上でのハードウェアアルゴリズムの評価(システムレベル設計,デザインガイア2008-VLSI設計の新しい大地)
- 配線遅延を考慮した回路モデル上でのハードウェアアルゴリズムの評価(システムレベル設計,デザインガイア2008-VLSI設計の新しい大地)
- 配線遅延を考慮した回路モデル上でのハードウェアアルゴリズムの評価(システムレベル設計,デザインガイア2008-VLSI設計の新しい大地-)
- 配線遅延を考慮したハードウェアアルゴリズムの評価
- A-3-14 省メモリ型HMM回路(A-3. VLSI設計技術)
- A-3-3 定数テストパターンによる 4-2 加算木のテスト
- 拡張ユークリッド法に基づくGF(2^m)上の乗算・逆元計算のための複合回路(演算回路/専用回路,システムオンシリコン設計技術並びにこれを活用したVLSI)
- 拡張ユークリッド法に基づくGF(2^m)上の乗算・逆元計算のための複合回路(演算回路/専用回路,システムオンシリコン設計技術並びにこれを活用したVLSI)
- A-3-2 反復回数を削減した拡張ユークリッド法に基づくGF(2^m)上の逆元算出アルゴリズム(A-3. VLSI設計技術, 基礎・境界)
- GF(2^m)上の逆元算出のための拡張ユークリッド法に基づくテーブルを用いたアルゴリズム(システム設計及び一般)
- GF(2^m)上の逆元算出のための拡張ユークリッド法に基づくテーブルを用いたアルゴリズム(システム設計及び一般)
- D-1-3 テーブルを用いた拡張ユークリッド法に基づくGF(2^m)上の逆元算出アルゴリズム(D-1. コンピュテーション)
- C-8-4 SFQ論理回路からの時刻付き論理式の抽出手法(C-8.超伝導エレクトロニクス,一般セッション)