高木 一義 | 名古屋大学大学院情報科学研究科:戦略的創造研究推進事業
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概要
関連著者
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高木 一義
名古屋大学大学院情報科学研究科:戦略的創造研究推進事業
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高木 一義
名古屋大学
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高木 直史
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高木 一義
名古屋大学大学院情報科学研究科
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名古屋大学大学院情報科学研究科情報システム学専攻
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横浜国立大学 工学部 電子情報工学科
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横浜国立大学大学院:crest-jst
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横浜国大工
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高木 一義
名古屋大学大学院:crest-jst
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京都大学大学院:crest-jst
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藤巻 朗
名古屋大学大学院工学研究科量子工学専攻
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横浜国立大学工学部
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山梨 裕希
横浜国立大学大学院
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横浜国立大学大学院 工学研究院
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Yoshikawa N
Yokohama National Univ. Yokohama Jpn
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小畑 幸嗣
名古屋大学 情報科学研究科
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小畑 幸嗣
名古屋大学大学院:crest-jst
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高木 一義
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永沢 秀一
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朴 熙中
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名古屋大学大学院工学研究科
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武富 一博
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京都大学大学院 情報学研究科 通信情報システム専攻
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吉川 信行
横浜国立大学大学院 工学府
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吉川 信行
横浜国立大学:jst-crest
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日高 睦夫
財)国際超電導産業技術研究センター
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原 浩史
横浜国立大学工学部電子情報工学科
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貝沼 世樹
横浜国立大学大学院
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原 浩史
横浜国立大学大学院:crest-jst
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藤巻 朗
名古屋大 大学院
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中村 一博
名古屋大学
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高木 直史
京都大学大学院情報学研究科
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島村 泰浩
横浜国立大学大学院
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藤巻 朗
名古屋大学:戦略的創造研究推進事業
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永沢 秀一
国際超電導産業技術研究センター超電導工学研究所
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日高 睦夫
超電導工学研究所
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島崎 亮
名古屋大学
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日野出 憲治
(財)国際超電導産業技術研究センター
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高瀬 英希
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高瀬 英希
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鬼頭 信貴
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日野出 憲治
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宮岡 史滋
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名古屋大学大学院情報科学研究科
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名古屋大学大学院情報科学研究科
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日高 睦夫
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宮岡 史滋
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永沢 秀一
ISTEC
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川口 隆広
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大野 真司
国立病院機構九州がんセンター 乳腺科
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国際超電導産業技術研究センター
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竹島 将太
名古屋大学
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吉川 信行
横浜国大 大学院工学研究院
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大野 真司
名古屋大学大学院情報科学研究科情報システム学専攻
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北川 佳廣
超電導工学研究所:crest-jst
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大野 真司
名古屋大学大学院 情報科学研究科 情報システム学専攻
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高木 直史
京都大学情報学研究科
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大野 真司
NPO法人ハッピーマンマ
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高木 一義
京都大学情報学研究科通信情報システム専攻
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須田 瑛大
京都大学大学院情報学研究科
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伊藤 勇也
京都大学大学院情報学研究科
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日高 睦夫
国際超電導産業技術研究センター超電導工学研究所
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日高 睦夫
国際超電導産技研センター
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高倉 弘喜
京都大学 情報学研究科
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朴 煕中
横浜国立大学大学院工学府
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田中 克典
日本電気株式会社 メディア情報研究所
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藤原 完
財団法人国際超電導産業技術研究センター超電導工学研究所
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永沢 秀一
財団法人国際超電導産業技術研究センター超電導工学研究所
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日高 睦夫
財団法人国際超電導産業技術研究センター超電導工学研究所
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山下 茂
奈良先端科学技術大学院大学 情報科学研究科
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高田 秀志
京都大学 情報学研究科
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高木 一義
京都大学工学部情報工学教室
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藤原 完
超電導工学研究所:日本学術振興会
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藤巻 朗
CREST-JST
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高木 直史
CREST-JST
-
高木 一義
CREST-JST
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尾野 紀博
名古屋大学大学院情報科学研究科
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佐藤 哲朗
(財)国際超電導産業技術研究センター
-
山下 茂
立命館大学
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藤原 完
超電導工学研
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日高 一輝
名古屋大学大学院情報科学研究科
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日高 睦夫
(財)国際超電導産業技術研究センター
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日名子 和也
横浜国立大学大学院:crest-jst
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成瀬 遥平
京都大学大学院情報学研究科
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加藤 泰一
横浜国立大学大学院
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高木 一義
京都大学:戦略的創造研究推進事業
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高木 一義
京都大学情報学研究科
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高木 一義
京都大学
著作論文
- Nbアドバンストプロセスを用いた単一磁束量子浮動小数点演算器の設計(ディジタル,一般)
- SFQ半精度浮動小数点乗算器の設計と試作(デジタル,一般)
- SFQ半精度浮動小数点加算器の設計と試作(デジタル,一般)
- C-8-10 SFQ浮動小数点乗算器の同期化および動作実証(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-9 アドバンスドプロセスを用いたSFQ半精度浮動小数点加算器の高速化に関する検討(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-13 Nb多層プロセスを用いて試作したシフトレジスタの測定評価(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-7 超伝導SFQ回路のための新Nb多層プロセス(C-8. 超伝導エレクトロニクス,一般セッション)
- Nb多層デバイス構造用セルライブラリに向けた最適なモート構造の検討(単一磁束量子大規模集積回路技術の現状と将来展望、デジタル応用及び一般)
- パイプライン動作を考慮した単一磁束量子回路のための論理設計検証手法(ディジタル,一般)
- トランスダクション法に基づく単一磁束量子回路合成のためのフレームワーク
- C-8-14 可変遅延素子を用いた単一磁束量子可変長シフトレジスタ(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-9 A^*アルゴリズムに基づく単一磁束量子回路受動線路配線ツールの実装と評価(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-12 SFQ半精度浮動小数点乗算器の試作と動作実証(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-18 SFQ半精度浮動小数点乗算器の設計と試作(C-8. 超伝導エレクトロニクス,一般セッション)
- C-8-15 10kA/cm^2Nbアドバンスドプロセスを用いたSFQ半精度浮動小数点乗算器の設計(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-5 10kA/cm^2Nbプロセスを用いたSFQ半精度浮動小数点加算器のコンポーネント回路の設計(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-2 単一磁束量子回路による冗長2進表現を用いたシストリックシリアル指数計算回路(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-1 単一磁束量子回路のためのパイプライン検証手法(C-8.超伝導エレクトロニクス,一般セッション)
- 再構成可能なデータパスに向けた単一磁束量浮動小数点除算器の実証(単一磁束量子大規模集積回路技術の現状と将来展望、デジタル応用及び一般)
- C-8-22 単一磁束量子回路のフロアプラン設計支援に向けた配線遅延時間の推定(C-8. 超伝導エレクトロニクス,一般セッション)
- 多層配線単一磁束量子回路のための自動配線手法(単一磁束量子大規模集積回路技術の現状と将来展望、デジタル応用及び一般)
- 多層配線単一磁束量子回路のための遅延余裕割り当てに基づく配線順序を考慮した配線手法 (VLSI設計技術)
- 多重高速保存型一括並列処理による省メモリな音声認識用HMM計算回路 (ディペンダブルコンピューティング)
- 多重高速保存型一括並列処理による省メモリな音声認識用HMM計算回路 (コンピュータシステム)
- C-8-12 ISTEC 10 kA/cm^2 Nbプロセスを用いた単一磁束量子浮動小数点乗算器の改良と動作評価(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-17 単一磁束量子回路のためのマルチサイクルパスを考慮した遅延素子削減手法(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-16 SFQ論理回路のタイミング明示化表現法と論理シミュレーション(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-15 クロック入力が不要な論理ゲートを用いたSFQ論理回路の構成法(C-8.超伝導エレクトロニクス,一般セッション)
- 多重高速保存型一括並列処理による省メモリな音声認識用HMM計算回路
- 多重高速保存型一括並列処理による省メモリな音声認識用HMM計算回路
- 二段階検証による順序回路の限定モデル検査の高速化手法(論理設計2,システムオンシリコンを支える設計技術)
- 単一磁束量子論理回路のためのタイミング故障のモデル化とテスト手法の検討(ディペンダブルシステム,組込み技術とネットワークに関するワークショップETNET2011)
- 単一磁束量子論理回路のためのタイミング故障のモデル化とテスト手法の検討(ディペンダブルシステム,組込み技術とネットワークに関するワークショップETNET2011)
- C-8-4 SFQ論理回路からの時刻付き論理式の抽出手法(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-3 ISTEC 10kA/cm^2 Nbプロセスを用いた単一磁束量浮動小数点乗算器内のクロック供給法の改善と評価(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-1 Nb-9層アドバンストプロセスを用いて試作したシフトレジスタの測定評価(C-8.超伝導エレクトロニクス,一般セッション)
- 大規模SFQ回路のためのNb多層アドパンストプロセスの開発(超伝導エレクトロニクス基盤技術及び一般)
- C-8-10 10kA/cm^2Nbプロセスを用いたSFQ半精度浮動小数点加算器の設計と測定評価(C-8.超伝導エレクトロニクス,一般セッション)
- C-8-14 SFQ回路におけるJTLとPTL混合配線のための回路分割手法(C-8.超伝導エレクトロニクス,一般セッション)
- A-3-5 高位合成における配列アクセス順序最適化によるループ並列化(A-3.VLSI設計技術,一般セッション)
- 浮動小数点演算器アレイの構成のための評価環境
- 高位合成における多面体最適化のためのスレッド構成手法
- 高位合成における多面体最適化のためのスレッド構成手法
- 浮動小数点演算器アレイの構成のための評価環境
- 単一磁束量子回路の設計検証のための時刻付き論理式の等価性判定手法(回路/システム設計,システムオンシリコンを支える設計技術)
- 高位合成における潜在的並列性を利用した投機実行に基づくCDFG変換(動作レベル設計と配線手法,システムオンシリコンを支える設計技術)