冗長2進表現を用いた右シフト剰余除算のハードウェアアルゴリズム
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概要
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剰余除算のハードウェアアルゴリズムを提案する. 最大公約数を求めるバィナリ法を拡張し, 右シフトと加減算の繰り返しによって剰余除算を行う. 拡張ユークリッド法に基づく手法に比べ制御が簡単になる. 内部表現に, 桁集合が{-1, 0, 1}である冗長2進表現を用いて, 加減算を高速化する. このアルゴリズムに基づく剰余除算器は, シフトレジスタと冗長2進加算器によって構成できる. 演算数の桁数に比例するクロック数で剰余除算を実行できる. クロックの周期(組合せ回路部の段数)は, 桁数に無関係な定数になる.ハードウェア量は演算数の桁数に比例する. 規則正しいビットスライス構造になり, 集積回路化に適している.
- 社団法人電子情報通信学会の論文
- 1996-01-26
著者
-
高木 直史
名古屋大学大学院情報科学研究科
-
矢島 脩三
京都大学工学部情報工学教室
-
中原 浩一
京都大学工学部情報工学科
-
矢島 脩三
京都大学工学部
-
矢島 脩三
京都大学大学院工学研究科情報工学教室
-
高木 直史
名古屋大学
-
矢島 脩三
京都大学工学研究科情報工学専攻
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